为了降低数字信号处理器(DSP)电路在太空中发生单粒子翻转事件,本文从触发器单元、存储模块及电路系统三个层面论述了 DSP的抗单粒子翻转加固设计.采用该抗单粒子翻转加固方法,实现了一款基于0.18 μm CMOS体硅工艺的DSP电路,该电路逻辑规模约为150万门,面积为9.3 mm×9.3 mm.通过重离子加速器模拟试验评估,该DSP电路的单粒子翻转率约为4.37×10-11错误/(位·天)(GEO轨道,等效3mmAl屏蔽).
数字信号处理器 单粒子翻转 抗单粒子翻转加固设计 辐照试验