module rom(data, address);
parameter DATA_WIDTH = 32;
parameter ADDR_WIDTH = 16;

output	[DATA_WIDTH - 1:0]	data;
input	[ADDR_WIDTH - 1:0]	address;

reg	[DATA_WIDTH - 1:0]	mem[0:1 << ADDR_WIDTH];

assign data = mem[address];

initial begin
	$readmemb("prog.list", mem);
end

endmodule