module common_clkinv (  I,
	ZN
	);

	// synopsys translate_off
	parameter C_DELAY = 0.0;
	// synopsys translate_on

	input  I;

	output ZN;

	wire   ZN;

	// synopsys translate_off
	generate
	if (C_DELAY > 0) begin: DELAY
		assign #C_DELAY ZN = ~I;
	end
	else begin: NO_DELAY
		// synopsys translate_on
		assign ZN = ~I;
		// synopsys translate_off
	end
	endgenerate
	// synopsys translate_on
endmodule