module vgatop(input clk, // 100MHz clk
	      input        rst,
	      input        clk25mhz,

	      output       hsync,
	      output       vsync,
	      output       rgb,

	      input [12:0] vmem_in_addr,
	      input [7:0]  vmem_in_data,
	      input        vmem_we);


   wire [12:0] 		   vmem_out_addr;
   wire [7:0] 		   vmem_out_data;
   
   vram vram1(.clk(clk),

	      .p1_addr(vmem_in_addr),
	      .p1_data(vmem_in_data),
	      .p1_we(vmem_we),

	      .p2_addr(vmem_out_addr),
	      .p2_data(vmem_out_data)
	      );

   vga vga1(.clk(clk),
	    .rst(rst),
	    .clk25mhz(clk25mhz),
	    
	    .vmem_data(vmem_out_data),
	    .vmem_addr(vmem_out_addr),
	    
	    .hsync(hsync),
	    .vsync(vsync),
	    .rgb(rgb));

endmodule