text:
CHƯƠNG 2: TỔ CHỨC HỆ THỐNG VI XỬ LÝ
Chia sẻ: Ha Van Tien | Ngày: | Loại File: PDF | Số trang:22
lượt xem 12
download
CHƯƠNG 2: TỔ CHỨC HỆ THỐNG VI XỬ LÝ
Tất cả các máy vi tính IBM họ PC hoặc các máy vi tính tương thích IBM đều sử dụng µP Intel họ iAPX. Bảng 2.1 liệt kê các đặc tính cơ bản của một số µP của Intel trong đó 80486 chứa một bộ điều khiển cache tích hợp và 8 KB RAM tĩnh, Pentium chứa cache 16 KB RAM tĩnh. Bảng 2.1: Kiến trúc các µP của Intel 8 bit, 16 bit và 32 bit
Bình luận(0) Đăng nhập để gửi bình luận!
Nội dung Text: CHƯƠNG 2: TỔ CHỨC HỆ THỐNG VI XỬ LÝ
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý CHƯƠNG 2: TỔ CHỨC HỆ THỐNG VI XỬ LÝ 1. Giới thiệu Tất cả các máy vi tính IBM họ PC hoặc các máy vi tính tương thích IBM đều sử dụng µP Intel họ iAPX. Bảng 2.1 liệt kê các đặc tính cơ bản của một số µP của Intel trong đó 80486 chứa một bộ điều khiển cache tích hợp và 8 KB RAM tĩnh, Pentium chứa cache 16 KB RAM tĩnh. Bảng 2.1: Kiến trúc các µP của Intel 8 bit, 16 bit và 32 bit ĐẶC TÍNH 8080 8086 8088 80186 80188 80286 80386 386SX 486/Pentium Bus địa chỉ (số 8 16 8 16 8 16 32 16 32 bit) Đường dữ liệu 8 16 16 16 16 16 32 32 32/64 nội (số bit) Tốc độ (MHz) 2,2.6, 5,8,10 5,8 8,10, 8,10, 6,8,10, 16,20,25, 16 25-66 6.3 12.5 12.5 12.5,20 33 Thanh ghi đến 1.3 0.3 0.38 0.2 0.3 0.125 0.125 0.125 0.04 thanh ghi (µs/word) Đáp ứng 7.3 6.1 8.6 3.36 6.2 2.52 3.5 2.52 3.5 interrupt (µs) Địa chỉ bộ nhớ 64K 1M 1M 1M 1M 16M 4G 4G 4G Cách định địa 5 24 24 24 24 24 28 28 28 chỉ Coprocessor 0 8087 8087 8087 8087 80287 80287/ 80287/ On chip 80387 80387 Số thanh ghi 6 8 8 8 8 8 8 8 8 đa dụng Số thanh ghi 0 4 4 4 4 4 6 6 6 đoạn Điều khiển 8259- 8259 8259- On On 8259- 8259-A 82335 µPLD interrupt A -A A chip chip A Timer – 8253 8253 8253/ On On 8253/ 8253/5 8253/5 On chip counter /54 54 chip chip 54 4 4 2. µP 8086/8088 2.1. Mô tả 2.1.1. Định thì chu kỳ bus Mỗi chu kỳ bus bắt đầu bằng việc xuất địa chỉ bộ nhớ hoặc I/O port (chu kỳ xung nhịp T1). Với 8086 thì địa chỉ này có thể là địa chỉ bộ nhớ 20 bit, địa chỉ I/O gián tiếp 16 bit (thanh ghi DX) hay địa chỉ I/O trực tiếp 8 bit. Bus điều khiển có 4 tín hiệu tác động mức thấp là MEMR , MEMW , IOR và IOW . Phạm Hùng Kim Khánh Trang 22
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Các chuỗi sự kiện xảy ra trong một chu kỳ bus đọc bộ nhớ: T1: µP xuất địa chỉ bộ nhớ 20 bit. Các đường dữ liệu không hoạt động và các đường điều khiển bị cấm T2: Đường điều khiển MEMR xuống mức thấp. Đơn vị bộ nhớ ghi nhận chu kỳ bus này là quá trình đọc bộ nhớ và đặt byte hay word có địa chỉ đó lên data bus. T3: µP đặt cấu hình để các đường data bus là nhập. Trạng thái này chủ yếu để bộ nhớ có thời gian tìm kiếm byte hay word dữ liệu T4: µP đợi dữ liệu trên data bus. Do đó, nó thực hiện chốt data bus và giải phóng các đường điều khiển đọc bộ nhớ. Quá trình này sẽ kết thúc chu kỳ bus. T1 T2 T3 T4 Clk Address bus Địa chỉ ra IOR hay Đọc bộ nhớ hay MEMR I/O Data bus Dữ liệu ra Address Địa chỉ vào bus Ghi bộ IOW hay nhớ hay MEMW I/O Dữ liệu vào Data bus Hình 2.1 – Định thì chu kỳ bus Trong một chu kỳ bus, µP có thể thực hiện đọc I/O, ghi I/O, đọc bộ nhớ hay ghi bộ nhớ. Các đường address bus và control bus dùng để xác định địa chỉ bộ nhớ hay I/O và hướng truyền dữ liệu trên data bus. Chú ý rằng µP điều khiển tất cả các quá trình trên nên bộ nhớ bắt buộc phải cung cấp được dữ liệu vào lúc MEMR lên mức cao trong trạng thái T4. Nếu không, µP sẽ đọc dữ liệu ngẫu nhiên không mong muốn trên data bus. Để giải quyết vấn đề này, ta có thể dùng thêm các trạng thái chờ (wait state). Phạm Hùng Kim Khánh Trang 23
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý 2.1.2. Mô tả chân 1 40 2 GND VCC 39 3 AD14 AD15 38 4 AD13 A16/S3 37 5 AD12 A17/S4 36 6 AD11 A18/S5 35 7 AD10 A19/S6 34 8 AD9 BHE/S7 33 9 AD8 MN/MX 32 10 AD7 RD 31 11 AD6 HOLD (RQ/GT0) 30 12 AD5 HLDA (RQ/GT1) 29 13 AD4 WR (LOCK) 28 14 AD3 IO/M (S2) 27 15 AD2 DT/R (S1) 26 16 AD1 DEN (S0) 25 17 AD0 ALE (QS0) 24 18 NMI INTA (QS1) 23 19 INTR TEST 22 20 CLK READY 21 GND RESET 8086 Hình 2.2 – Sơ đồ chân của 8086 8086 có bus địa chỉ 20 bit, bus dữ liệu 16 bit, 3 chân nguồn và 17 chân dùng cho các chức năng điều khiển. Tuy nhiên, ta có thể dùng kỹ thuật ghép kênh thời gian (time multiplexing) để cho phép một chân có nhiều chức năng nên các chân sẽ được phân ra: - 16 chân dữ liệu và địa chỉ (AD0 ÷ AD15): các chân này sẽ là các đường địa chỉ trong trạng thái T1 và dữ liệu trong các trạng thái T2 – T4. - 4 chân địa chỉ và trạng thái - 3 chân nguồn - 17 chân định thì và điều khiển 8086 có thể hoạt động ở chế độ tối thiểu (minimum mode) hay chế độ tối đa (maximum mode). Chế độ tối thiểu chỉ dùng cho các hệ thống µP đơn giản còn chế độ tối đa dùng cho các hệ thống phúc tạp hơn giao tiếp với các bộ nhớ và I/O riêng. Phạm Hùng Kim Khánh Trang 24
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Các tín hiệu chung cho cả hai chế độ tối đa và tối thiểu: Bảng 2.2: Chân Chức năng Loại AD15 ÷ AD0 Bus dữ liệu / địa chỉ 2 chiều, 3 trạng thái A19/S6 ÷ A16/S3 Địa chỉ / trạng thái Ngõ ra 3 trạng thái MX Điều khiển chế độ Ngõ vào RD Điều khiển đọc Ngõ ra 3 trạng thái TEST Chờ kiểm tra điều khiển Ngõ vào READY Chờ trạng thái điều khiển Ngõ vào RESET Reset hệ thống Ngõ vào NMI Yêu cầu ngắt không thể che Ngõ vào INTR Yêu cầu ngắt Ngõ vào CLK Xung nhịp hệ thống Ngõ vào VCC +5V Ngõ vào GND GND Ngõ vào Các tín hiệu chỉ dùng trong chế độ tối thiểu: Bảng 2.3: Chân Chức năng Loại HOLD Yêu cầu giữ Ngõ vào HLDA Ghi nhận giữ Ngõ vào WR Điều khiển ghi Ngõ ra 3 trạng thái IO/ M Điều khiển I/O và bộ nhớ Ngõ ra 3 trạng thái DT/ R Truyền / nhận dữ liệu Ngõ ra 3 trạng thái DEN Cho phép dữ liệu Ngõ ra 3 trạng thái BHE /S7 Đường trạng thái Ngõ ra 3 trạng thái ALE Cho phép chốt địa chỉ Ngõ ra INTA Ghi nhận ngắt Ngõ ra Các tín hiệu chỉ dùng trong chế độ tối đa: Bảng 2.4: Chân Chức năng Loại RQ / GT1,0 Yêu cầu / cấp bus 2 chiều LOCK Điều khiển khóa ưu tiên bus Ngõ ra 3 trạng thái S2 ÷ S0 Trạng thái chu kỳ bus Ngõ ra 3 trạng thái QS1, QS2 Trạng thái hàng lệnh Ngõ ra Phạm Hùng Kim Khánh Trang 25
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Trạng thái bus: Bảng 2.5: Ngõ vào trạng thái Chu kỳ CPU S2 S1 S0 0 0 0 Ghi nhận ngắt 0 0 1 Đọc I/O port 0 1 0 Ghi I/O port 0 1 1 Ngừng 1 0 0 Nhận lệnh 1 0 1 Đọc bộ nhớ 1 1 0 Ghi bộ nhớ 1 1 1 Thụ động Trạng thái hàng lệnh: Bảng 2.6: QS1 QS0 Trạng thái hàng lệnh 0 0 Không hoạt động 0 1 Lấy byte đầu tiên của lệnh 1 0 Hàng rỗng 1 1 Lấy byte kế tiếp Nguồn cung cấp và xung nhịp (VCC, GND và CLK): - 8086 sử dụng nguồn cấp điện +5V và có 2 chân đất. - Dòng điện cực đại là 340 mA (10 mA cho loại CMOS). - Xung nhịp dùng dạng xung chữ nhật có chu kỳ với thời gian cạnh lên và xuống nhỏ hơn 10 ns. - Tiêu hao công suất và tần số xung nhịp cực đại: Các chân trạng thái trong chế độ tối đa (S0, S1 và S2 - status): Các chân này sử dụng bởi bộ điều khiển bus 8288 để tạo các tín hiệu điều khiển như bảng 2.5. Các chân điều khiển bus (HOLD, HLDA, RQ / GT0 , RQ / GT1 , LOCK ): Chế độ tối thiểu: - HOLD (giữ): ngõ vào tác động mức cao làm cho µP hở mạch tất cả các bus của nó, tách µP khỏi bộ nhớ của nó và I/O để cho phép thiết bị khác xử lý Phạm Hùng Kim Khánh Trang 26
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý bus hệ thống. Quá trình này gọi là truy xuất bộ nhớ trực tiếp (DMA – Direct Memory Access). - HLDA (Hold acknowledge): ghi nhận yêu cầu DMA đối với bộ điều khiển DMA. Chế độ tối đa: - RQ / GT0 , RQ / GT1 (Request / Grant): các chân này dùng cả hai chức năng vào (nhận yêu cầu) và ra (chấp nhận yêu cầu). Khi một thiết bị muốn lấy điều khiển của bus cục bộ, nó sẽ phát yêu cầu bằng cách đưa tín hiệu mức thấp vào chân yêu cầu. Sau khi nhận yêu cầu, 8086 sẽ ở trạng thái HOLD và gởi tín hiệu chấp nhận ra chân này. Ở đây, chân RQ / GT0 có độ ưu tiên cao hơn chân RQ / GT1 . - LOCK : báo cho các thiết bị khác biết không thể lấy điều khiển của bus cục bộ. Các chân ngắt (NMI, INTR và INTA ): INTR và NMI là các yêu cầu ngắt khởi động bằng phần cứng, làm việc chính xác như các ngắt mềm. NMI (Non-Maskable Interrupt) là ngõ vào tác động cạnh lên. NMI là ngắt không thể che được và luôn được phục vụ, thường dùng cho các sự kiện như hư nguồn hay các lỗi bộ nhớ. INTR tác động mức cao và có thể bị che bằng cách xoá cờ IF trong thanh ghi cờ (xem 2.3.4) bằng lệnh CLI. Khi NMI tích cực, điều khiển sẽ được chuyển đến địa chỉ chứa trong các vị trí 00008h ÷ 0000Bh. Khi INTR tích cực, chu kỳ ghi nhận ngắt (interrupt acknowledge cycle) được thực hiện. Quá trình này giống như chu kỳ đọc bộ nhớ ngoại trừ INTA tích cực thay vì RD . Thiết bị tạo ngắt sẽ đặt một giá trị 8 bit vào data bus và chuyển điều khiển đến vị trí giá trị × 4 đến giá trị × 4 + 3. Chân RESET: hoạt động khi có xung tác động mức cao, dùng để khởi động lại (P. Sau khi khởi động, (P sẽ đọc lệnh tại địa chỉ FFFF0h. RESET được sử dụng khi hệ thống có sự cố. Các chân điều khiển bus (READY, RD , ALE, DEN , DT/ R , WR và IO/ M ): Trong các chân điều khiển này, chỉ có hai chân READY và RD làm việc ở chế độ tối đa. - Chân READY: ngõ vào READY được lấy mẫu ở cạnh lên của xung nhịp T2. Nếu chân này ở mức thấp (không sẵn sàng) thì sẽ thêm vào một chu kỳ T3 nữa. Chu trình này sẽ tiếp tục cho đến khi nào chân READY lên mức cao. Ngõ vào này thường được điều khiển bởi thiết bị bộ nhớ chậm, không thể cung cấp dữ liệu kịp thời cho µP. - Chân IO/ M (IO/Memory – Xuất nhập /Bộ nhớ): xác định chu kỳ bus hiện hành làm việc với bộ nhớ (mức thấp) hay I/O (mức cao). Phạm Hùng Kim Khánh Trang 27
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý - Chân RD (Read): tín hiệu tác động mức thấp chỉ chiều truyền dữ liệu từ bộ nhớ hay I/O đến µP. Ta có thể kết hợp với tín hiệu này với IO/ M để tạo các tín hiệu MEMR và IOR . Nó được xuất ra trong trạng thái T2 và lấy đi trong trạng thái T4. Thiết bị bộ nhớ hay I/O giả sử là đã đặt byte hay word vào các đường dữ liệu khi RD trở về mức cao. - Chân WR (Write): tín hiệu này ngược với RD , nó xác định chiều truyền dữ liệu từ µP đến I/O hay bộ nhớ. RD 1 2 1 MEMR 3 2 1 IOR 3 IO/ M 1 2 2 1 3 IOW 2 1 3 MEMW WR 1 2 2 Hình 2.3 – Tạo tín hiệu điều khiển bộ nhớ và I/O - Chân ALE (Address Latch Enable - cho phép chốt địa chỉ): tín hiệu ra trên chân này có thể dùng để phân kênh các đường địa chỉ, dữ liệu và trạng thái trên AD0 ÷ AD15, A16/S3 ÷ A19/S6 và BHE /S7. Mọi chu kỳ bắt đầu với xung ALE trong trạng thái T1. Địa chỉ 20 bit được bảo đảm sẽ hợp lệ khi ALE chuyển từ mức cao xuống mức thấp. - Chân DEN (Data Enable – cho phép dữ liệu): tín hiệu này được dùng với DT/ R để cho phép nối các bộ đệm hai chiều vào data bus. Nó ngăn ngừa sự tranh chấp bus bằng cách cấm các bộ đệm dữ liệu cho đến trạng thái T2 khi các đường dữ liệu / địa chỉ không còn lưu trữ địa chỉ của bộ nhớ hay I/O. - Chân DT/ R (Data transmit/receive – truyền/nhận dữ liệu): dùng để điều khiển chiều của luồng dữ liệu qua các bộ đệm (nếu có) vào bus dữ liệu của hệ thống. Khi ở mức thấp, nó chỉ thực hiện tác vụ đọc và khi ở mức cao nó chỉ thực hiện tác vụ ghi. Phạm Hùng Kim Khánh Trang 28
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý T1 T2 T3 T4 Clk ALE IO/ M Địa chỉ / trạng thái A16 ÷ A19, BHE S3 ÷ S7 Dữ liệu vào AD0 ÷ AD15 A0 ÷ A15 D0 ÷ D15 Chu kỳ RD đọc DT/ R DEN AD0 ÷ AD15 A0 ÷ A15 Döõ lieäu ra D0 ÷ D15 Chu kỳ RD ghi DT/ R DEN Hình 2.4 – Các chu kỳ đọc và ghi của 8086 Các chân trạng thái (AD16/S3 ÷ AD19/S6 và BHE /S7): 5 tín hiệu trạng thái này được xuất ra trong các trạng thái T2 ÷ T4, dùng cho các mục đích kiểm tra. Bit S7 là bit trạng thái dư (không dùng), bit S6 luôn bằng 0, S5 mô tả trạng thái của cờ ngắt IF còn S3, S4 dùng để xác định đoạn đang sử dụng: Bảng 2.7: S4 S3 Đoạn 0 0 Thêm 0 1 Stack 1 0 Mã (hay không) 1 1 Dữ liệu Phạm Hùng Kim Khánh Trang 29
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Tín hiệu BHE /S7 (Bus High Enable) chỉ được xuất trong trạng thái T1. Khi chân này ở mức thấp, nó sẽ chỉ AD8 ÷ AD15 liên quan đến việc truyền dữ liệu. Quá trình này có thể xảy ra đối với các truy xuất bộ nhớ, I/O hay truy xuất 1 byte dữ liệu từ địa chỉ lẻ. Bus dữ liệu (AD0 ÷ AD15): 16 chân này tạo thành bus dữ liệu hai chiều. Các đường này chỉ hợp lệ trong các trạng thái T2 ÷ T4. Trong trạng thái T1, chúng giữ 16 bit thấp của địa chỉ bộ nhớ hoặc I/O. Bus địa chỉ (AD0 ÷ AD15 và AD16/S3 ÷ AD19/S6): 20 chân này tương ứng với bus địa chỉ 20 bit và cho phép µP truy xuất 1 MB vị trí bộ nhớ. Các đường ra này chỉ hợp lệ trong trạng thái T1, chuyển thành các đường dữ liệu và trạng thái trong trạng thái T2 ÷ T4. Chọn chế độ MX : Chân này dùng để chọn chế độ hoạt động cho 8086, nếu ở mức cao thì sẽ hoạt động ở chế độ tối thiểu còn ở mức thấp thì sẽ hoạt động ở chế độ tối đa. 2.2. Kiến trúc nội µP có khả năng thực hiện các tác vụ dữ liệu theo tập lệnh bên trong. Một lệnh được ghi nhận bằng mã đã được định nghĩa trước, gọi là mã lệnh (opcode). Trước khi thực thi một lệnh, µP phải nhận được mã lệnh từ bộ nhớ chương trình của nó. Quá trình xử lý này gọi là chu kỳ nhận lệnh (fetch cycle). Một khi các mã được nhận và được giải mã thì mạch bên trong µP có thể tiến hành thực thi (execute) mã lệnh. BIU EU ← Hàng lệnh ← Bus hệ thống Hình 2.5 – Kiến trúc nội của µP 8086 BIU (Bus Interface Unit – đơn vị giao tiếp bus) nhận các mã lệnh từ bộ nhớ và đặt chúng vào hàng chờ lệnh. EU (Execute Unit – đơn vị thực thi) sẽ giải mã và thực hiện các lệnh trong hàng. Chú ý rằng các đơn vị EU và BIU làm việc độc lập với nhau nên BIU có khả năng đang nhận một lệnh mới trong khi EU dang thực thi lệnh trước đó. Khi EU đã thực hiện xong lệnh, nó sẽ lấy mã lệnh kế tiếp trong hàng đợi lệnh (instruction queue). Phạm Hùng Kim Khánh Trang 30
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Kiến trúc nội của µP 8086 ở hình 2.2. Nó có 2 bộ xử lý riêng: BIU và EU. BIU cung cấp các chức năng phần cứng, bao gồm tạo các địa chỉ bộ nhớ và I/O để chuyển dữ liệu giữa EU và bên ngoài µP. BIU EU Điều khiển bus và sinh địa chỉ Σ AH AL 5 BH BL 4 CH CL 3 DH DL CS 2 BP ES 1 DI SS SI DS SP IP Internal bus Thanh ghi cờ ALU Hình 2.6 – Kiến trúc nội của 8086 EU nhận các mã lệnh chương trình và dữ liệu từ BIU, thực thi các lệnh này và chứa các kết quả trong các thanh ghi. Ngoài ra, dữ liệu cũng có thể chứa trong một vị trí bộ nhớ hay được ghi vào thiết bị xuất. Chú ý rằng EU không có bus hệ thống nên phải thực hiện nhận và xuất tất cả các dữ liệu của nó thông qua BIU. Sự khác biệt giữa µP 8086 và 8088 là BIU. Trong 8088, đường bus dữ liệu là 8 bit trong khi của 8086 là 16 bit. Ngoài ra hàng lệnh của 8088 dài 4 byte trong khi của 8086 là 6 byte. Phạm Hùng Kim Khánh Trang 31
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Tuy nhiên do EU giữa hai loại µP này giống nhau nên các chương trình viết cho 8086 có thể chạy được trên 8088 mà không cần thay đổi gì cả. Quá trình nhận lệnh và thực thi lệnh: 1/ BIU xuất nội dung của thanh ghi con trỏ lệnh IP (Instruction Pointer) ra bus địa chỉ để chọn byte hay word đọc vào BIU. 2/ Thanh ghi IP được tăng thêm 1 để chuẩn bị nhận lệnh kế. 3/ Khi lệnh ở trong BIU, nó được đưa sang hàng lệnh (queue). Đây là một thanh ghi lưu trữ dạng FIFO (First In First Out – Vào trước ra trước), dùng cơ chế xử lý xen kẽ liên tục các dòng mã lệnh (kỹ thuật đường ống – pipelining). 4/ Giả sử ban đầu hàng lệnh trống, EU sẽ không làm gì cả cho đến khi bắt đầu xuất hiện một lệnh trong hàng, EU sẽ lấy lệnh ra khỏi hàng và bắt đầu thực thi lệnh đó. 5/ Trong khi EU đang thực thi lệnh, BIU tiến hành nhận lệnh mới. Tuỳ theo thời gian thực thi lệnh mà BIU có thể đưa vào hàng lệnh nhiều lệnh mới trước khi EU thực hiện lệnh xong và tiếp tục lấy lệnh mới. BIU được lập trình để có thể nhận một lệnh mới bất kỳ lúc nào hàng lệnh có chỗ cho 1 byte (8088) hay 2 byte (8086). Lợi ích của phương pháp xử lý theo cơ chế pipeline là EU có thể thực thi các lệnh gần như liên tục thay vì phải đợi BIU nhận thêm lệnh mới. Nhận Thực thi Nhận Thực thi Nhận Thực thi (a) Nhận (1) Nhận (2) Nhận (3) Đọc Nhận (4) Nhận (4) Nhận Chờ Thực thi Chờ Thực thi Thực thi Thực thi Chờ Nhận (b) (1): lệnh thực thi không cần dữ liệu trong hàng (2): lệnh thực thi cần dữ liệu trong hàng (3): lệnh nhảy (4): các lệnh bị bỏ qua do lệnh nhảy Hình 2.7 (a) µP thông thường dùng chu kỳ nhận và thực thi lệnh tuần tự (b) kiến trúc dạng pipeline của 8086/8088 cho phép thực thi các lệnh mà không bị trễ do quá trình nhận lệnh Có 3 điều kiện làm cho EU ở chế độ chờ: - Điều kiện thứ nhất xảy ra khi lệnh cần truy xuất đến một vị trí bộ nhớ không ở trong hàng. BIU phải treo quá trình nhận lệnh và xuất ra địa chỉ của ô nhớ này. Sau khi truy xuất bộ nhớ, EU có thể tiếp tục quá trình thực thi lệnh từ hàng lệnh và BIU có thể tiếp tục đưa các lệnh vào hàng. Phạm Hùng Kim Khánh Trang 32
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý - Điều kiện thứ hai xảy ra khi lệnh được thực thi là lệnh nhảy (jump). Trong trường hợp này, thay vì dùng địa chỉ lệnh kế tiếp, ta phải chuyển đến địa chỉ mới (không tuần tự). Tuy nhiên, BIU vẫn luôn đặt các lệnh theo tuần tự và do đó sẽ lưu các lệnh không sử dụng. Trong khi nhận lệnh kế tiếp tại địa chỉ do lệnh jump chỉ đến, EU phải đợi và tất cả các byte trong hàng phải bỏ. - Điều kiện thứ ba có thể làm BIU treo quá trình nhận lệnh đó là khi thực thi các lệnh có thời gian thực thi lớn. Giả sử như lệnh AAM (ASCII Adjust for Multiplication) cần 83 chu kỳ xung nhịp để hoàn tất trong khi đó với 4 chu kỳ xung nhịp cho quá trình nhận lệnh thì hàng sẽ bị đầy. Như vậy BIU phải đợi cho đến khi lệnh được thực hiện xong và EU nhận mã lệnh từ hàng thì mới có thể tiếp tục quá trình nhận lệnh. 2.3. Các thanh ghi µP 8086/8088 có tất cả 14 thanh ghi nội. Các thanh ghi này có thể phân loại như sau: - Thanh ghi dữ liệu (data register) - Thanh ghi chỉ số và con trỏ (index & pointer register) - Thanh ghi đoạn (segment register) - Thanh ghi trạng thái và điều khiển (status & control register) 2.3.1. Các thanh ghi dữ liệu Các thanh ghi dữ liệu gồm có các thanh ghi 16 bit AX, BX, CX và DX trong đó nửa cao và nửa thấp của mỗi thanh ghi có thể định địa chỉ một cách độc lập. Các nửa thanh ghi này (8 bit) có tên là AH và AL, BH và BL, CH và CL, DH và DL. Các thanh ghi này được sử dụng trong các phép toán số học và logic hay trong quá trình chuyển dữ liệu. Bảng 2.8: Thanh ghi Sử dụng trong AX MUL, IMUL (toán hạng nguồn kích thước word) DIV, IDIV (toán hạng nguồn kích thước word) IN (nhập word) OUT (xuất word) CWD Các phép toán xử lý chuỗi (string) AL MUL, IMUL (toán hạng nguồn kích thước byte) DIV, IDIV (toán hạng nguồn kích thước byte) IN (nhập byte) OUT (xuất byte) XLAT AAA, AAD, AAM, AAS (các phép toán ASCII) CBW (đổi sang word) DAA, DAS (số thập phân) Các phép toán xử lý chuỗi (string) Phạm Hùng Kim Khánh Trang 33
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý AH MUL, IMUL (toán hạng nguồn kích thước byte) DIV, IDIV (toán hạng nguồn kích thước byte) CBW (đổi sang word) BX XLAT CX LOOP, LOOPE, LOOPNE Các phép toán string với tiếp dầu ngữ REP CL RCR, RCL, ROR, ROL (quay với số đếm byte) SHR, SAR, SAL (dịch với số đếm byte) DX MUL, IMUL (toán hạng nguồn kích thước word) DIV, IDIV (toán hạng nguồn kích thước word) AX (ACC – Accumulator): thanh ghi tích luỹ BX (Base): thanh ghi cơ sở CX (Count): đếm DX (Data): thanh ghi dữ liệu 2.3.2. Các thanh ghi chỉ số và con trỏ Bao gồm các thanh ghi 16 bit SP, BP, SI và DI, thường chứa các giá trị offset (độ lệch) cho các phần tử định địa chỉ trong một phân đoạn (segment). Chúng có thể được sử dụng trong các phép toán số học và logic. Hai thanh ghi con trỏ (SP – Stack Pointer và BP – Base Pointer) cho phép truy xuất dễ dàng đến các phần tử đang ở trong ngăn xếp (stack) hiện hành. Các thanh ghi chỉ số (SI – Source Index và DI – Destination Index) được dùng để truy xuất các phần tử trong các đoạn dữ liệu và doạn thêm (extra segment). Thông thường, các thanh ghi con trỏ liên hệ đến đoạn stack hiện hành và các thanh ghi chỉ số liên hệ đến doạn dữ liệu hiện hành. SI và DI dùng trong các phép toán chuỗi. 2.3.3. Các thanh ghi đoạn Bao gồm các thanh ghi 16 bit CS (Code segment), DS (Data segment), SS (stack segment) và ES (extra segment), dùng để định địa chỉ vùng nhớ 1 MB bằng cách chia thành 16 đoạn 64 KB. Tất cả các lệnh phải ở trong đoạn mã hiện hành, được định địa chỉ thông qua thanh ghi CS. Offset (độ lệch) của mã được xác định bằng thanh ghi IP. Dữ liệu chương trình thường được đặt ở đoạn dữ liệu, định vị thông qua thanh ghi DS. Stack định vị thông qua thanh ghi SS. Thanh ghi đoạn thêm có thể sử dụng để định địa chỉ các toán hạng, dữ liệu, bộ nhớ và các phần tử khác ngoài đoạn dữ liệu và stack hiện hành. 2.3.4. Các thanh ghi điều khiển và trạng thái Thanh ghi con trỏ lệnh IP (Instruction Pointer) giống như bộ đếm chương trình (Program Counter). Thanh ghi điều khiển này do BIU quản lý nhằm lưu trữ offset từ bắt đầu đoạn mã đến lệnh thực thi kế tiếp. Ta không thể xử lý trực tiếp trên thanh ghi IP. Thanh ghi cờ (Flag register) hay từ trạng thái 16 bit chứa 3 bit điều khiển (TF, IF và DF) và 6 bit trạng thái (OF, SF, ZF, AF, PF và CF) còn các bit còn lại mà 8086/8088 không sử dụng thì không thể truy xuất được. Phạm Hùng Kim Khánh Trang 34
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý 15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0 X X X X OF DF IF TF SF ZF X AF X PF X CF - OF (Overflow - tràn): OF = 1 xác định tràn số học, xảy ra khi kết quả vượt ra ngoài phạm vi biểu diễn - DF (Direction- hướng): xác định hướng chuyển string, DF = 1 khi µP làm việc với string theo thứ tự từ phải sang trái. - IF (Interrupt - ngắt): cho phép hay cấm các interrupt có mặt nạ - TF (Trap - bẫy): đặt µP vào chế độ từng bước, dùng cho các chương trình gỡ rối (debugger). - SF (Sign - dấu): dùng để chỉ các kết quả số học là số dương (SF = 0) hay âm (SF = 1). - ZF (Zero): = 1 nếu kết quả của phép toán trước là 0. - AF (Auxiliary – nhớ phụ): dùng trong các số thập phân để chỉ nhớ từ nửa byte thấp hay mượn từ nửa byte cao. - PF (Parity): PF = 1 nếu kết quả của phép toán là có tổng số bit 1 là chẵn (dùng để kiểm tra lỗi truyền dữ liệu) - CF (Carry): CF = 1 nếu có nhớ hay mượn từ bit cao nhất của kết quả. Cờ này cũng dùng cho các lệnh quay. 2.4. Phân đoạn bộ nhớ Ta biết rằng dù 8086 là µP 16 bit (có bus dữ liệu 16 bit) nhưng vẫn dùng bộ nhớ theo các byte. Điều này cho phép µP làm việc với byte cũng như word, nó rất quan trọng trong giao tiếp với các thiết bị I/O như máy in, thiết bị đầu cuối và modem (chúng được thiết kế để chuyển dữ liệu mã hoá ASCII 7 hay 8 bit). Ngoài ra, nhiều mã lệnh của 8086/8088 có chiều dài 1 byte nên cần phải truy xuất được các byte riêng biệt để có thể xử lý các lệnh này. 8086/8088 có bus địa chỉ 20 bit nên có thể cho phép truy xuất 220 = 1048576 địa chỉ bộ nhớ khác nhau. Byte 1048575 Word 524287 Byte 1048574 Byte 1 Word 0 Byte 0 Hình 2.8 – Vùng nhớ của 8086/8088 có 1048576 byte hay 524288 word Để thực hiện đọc 16 bit từ bộ nhớ, 8086 sẽ thực hiện đọc đồng thời byte có địa chỉ lẻ và byte có địa chỉ chẵn. Do đó, 8086 tổ chức bộ nhớ thành các bank chẵn và lẻ. Theo hình 2.8, ta có thể thấy rằng các word luôn bắt đầu tại địa chỉ chẵn nhưng ta vẫn Phạm Hùng Kim Khánh Trang 35
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý có thể đọc word có địa chỉ lẻ bằng cách thực hiện 2 chu kỳ đọc bộ nhớ: một chu kỳ đọc byte thấp và một chu kỳ đọc byte cao. Điều này sẽ làm chậm tốc độ xử lý. Đối với 8088 thì do bus dữ liệu 8 bit nên dù word có địa chỉ chẵn hay lẻ, nó cũng cần phải thực hiện 2 chu kỳ đọc hay ghi bộ nhớ và giao tiếp với bộ nhớ như một bank. Byte 1048574 Byte 1048575 Byte 1048575 Byte 1048572 Byte 1048573 Byte 1048574 Byte 2 Byte 3 Byte 3 Byte 0 Byte 1 Byte 2 Đọc lần 2 Byte 1 Đọc lần 1 Byte 0 Word dữ liệu 16 bit Hình 2.9 – Đọc word địa chỉ chẵn và địa chỉ lẻ Ngoài ra bộ nhớ cũng chia thành 16 khối, mỗi khối có kích thước 64 KB, bắt đầu ở địa chỉ 00000h và kết thúc ở FFFFFh. Địa chỉ bắt đầu mỗi khối sẽ tăng lên 1 ở số hex có ý nghĩa nhiều nhất khi thay đổi từ khối này sang khối kia. Ví dụ như khối 00000h → 10000h → 20000h … FFFFFh FFFFFh Dự trữ FFFFBh F0000h Dành riêng FFFF0h 0007Fh Dự trữ 20000h 10000h 00013h Dành riêng 00000h 00000h Hình 2.10 – Bảng bộ nhớ cho 8086/8088 Phạm Hùng Kim Khánh Trang 36
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Các thanh ghi phân đoạn: 8086/8088 định nghĩa 4 khối bộ nhớ 64KB: đoạn mã (code segment) giữ các mã lệnh chương trình, đoạn ngăn xếp (stack segment) lưu các địa chỉ sẽ trả về từ các chương trình con (subroutine) hay trình phục vụ ngắt (interrupt subroutine), đoạn dữ liệu (data segment) lưu trữ dữ liệu cho chương trình và đoạn thêm (extra segment) thường dùng cho các dữ liệu dùng chung. Các thanh ghi đoạn (CS, DS, SS và ES) dùng để chỉ vị trí nền của mỗi đoạn. Các thanh ghi này có 16 bit trong khi địa chỉ bộ nhớ là 20 bit nên để xác dịnh vị trí bộ nhớ, ta sẽ thêm 4 bit 0 vào các bit thấp của thanh ghi đoạn. Giả sử như thanh ghi CS chứa giá trị 1111h thì nó sẽ chỉ tới địa chỉ nền là 11110h. Chú ý rằng địa chỉ bắt đầu một đoạn không thể tuỳ ý mà phải bắt đầu tại một địa chỉ chia hết cho 16. Nghĩa là 4 bit thấp phải là 0. Ta cũng chú ý rằng 4 đoạn có thể không tách rời nhau mà chồng lấp lên nhau và ta cũng có thể cho 4 giá trị của các thanh ghi đoạn bằng nhau nghĩa là 4 đoạn này trùng nhau. VD: Thanh ghi DS có giá trị là 1000h thì địa chỉ nền là 10000h. Địa chỉ kết thúc tìm được bằng cách cộng địa chỉ nền với giá trị FFFFh (64K) → địa chỉ kết thúc là 10000h + FFFFh = 1FFFFh. Như vậy đoạn dữ liệu có địa chỉ từ 10000h = 1FFFFh. Các vị trí bộ nhớ không được định nghĩa trong các đoạn hiện hành không thể truy xuất được. Muốn truy xuất đến các vị trí đó, ta phải định nghĩa lại một trong các thanh ghi đoạn sau cho đoạn phải chứa vị trí đó. Như vậy, tại một thời điểm bất kỳ ta chỉ có thể truy xuất tối đa 4 × 64 KB = 256 KB bộ nhớ. Nội dung của các thanh ghi đoạn chỉ có thể xác định thông qua phần mềm. VD: Giả sử các thanh ghi đoạn có các giá trị CS = 2800h, DS = E000h, SS = 2900h và ES = 1000h. Ta có vị trí các đoạn trong bảng bộ nhớ như sau: EFFFFh Đoạn dữ liệu E0000h 38FFFh Đoạn stack 29000h ÷ 38FFFh 37FFFh 29000h Đoạn mã 28000h ÷ 37FFFh 28000h 1FFFFh Đoạn thêm 10000h Hình 2.11 – Vị trí các phân đoạn theo giá trị các thanh ghi đoạn Phạm Hùng Kim Khánh Trang 37
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Địa chỉ logic và địa chỉ vật lý: Các địa chỉ trong một đoạn thay đổi từ 0000h ÷ FFFFh, tương ứng với chiều dài đoạn là 64 KB. Một địa chỉ trong một đoạn được gọi là địa chỉ logic hay offset. Ví dụ như địa chỉ logic 0010h của đoạn mã trong hình 2.11 sẽ có địa chỉ thật sự là 28000h + 0010h = 28010h. Địa chỉ này gọi là địa chỉ vật lý. Như vậy, địa chỉ vật lý chính là địa chỉ thật sự xuất hiện ở bus địa chỉ, nó có chiều dài 20 bit còn địa chỉ logic là độ lệch (offset) từ vị trí 0 của một đoạn cho trước. VD: Giả sử xét các đoạn như hình 2.11. Địa chỉ vật lý tương ứng với địa chỉ logic 1000h trong đoạn stack là: 29000h + 1000h = 2A000h Địa chỉ vật lý tương ứng với địa chỉ logic 2000h trong đoạn mã là: 28000h + 2000h = 2A000h Ta thấy rằng có thể địa chỉ vật lý trùng nhau khi địa chỉ logic khác nhau nghĩa là một địa chỉ vật lý có thể có nhiều địa chỉ logic khác nhau. Để chỉ địa chỉ logic 1000h trong đoạn mã, ta dùng ký hiệu CS:1000h. Tương tự như vậy cho các đoạn khác, nghĩa là địa chỉ logic 1111h trong đoạn dữ liệu sẽ là DS:1111h. Mọi lệnh tham chiếu bộ nhớ sẽ có một thanh ghi đoạn mặc nhiên. Thanh ghi IP cung cấp địa chỉ offset khi truy xuất đến đoạn mã và BP cho đoạn stack. Ví dụ như IP = 1000h và CS = 2000h thì BIU sẽ truy xuất đến địa chỉ 20000h + 1000h = 21000h và nhận byte tại vị trí này. Bảng 2.9: Tham chiếu bộ nhớ Đoạn mặc nhiên Đoạn khác Offset Nhận lệnh CS Không IP Tác vụ stack SS Không SP Dữ liệu tổng quát DS CS,ES,SS Địa chỉ hiệu dụng Nguồn của string DS CS,ES,SS SI Đích của string ES Không DI BX dùng làm con trỏ DS CS,ES,SS Địa chỉ hiệu dụng BP dùng làm con trỏ SS CS,ES,SS Địa chỉ hiệu dụng VD: Ta sử dụng lệnh MOV [BP],AL với BP = 2C00h. Ở đây BP dùng làm con trỏ nên dùng đoạn stack. Giả sử các phân đoạn như hình 2.11 thì địa chỉ vật lý sẽ là 29000h + 2C00h = 2BC00h Định nghĩa các vị trí bộ nhớ: Thông thường ít khi nào ta cần biết đến địa chỉ vật lý của một vị trí bộ nhớ mà ta chỉ quan tâm đến địa chỉ logic của nó mà thôi. Lý do là vì địa chỉ vật lý còn phải phụ thuộc vào nội dung của các thanh ghi đoạn ngay cả khi địa chỉ logic giữ không đổi như đã xét ở trên. Phạm Hùng Kim Khánh Trang 38
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Khi viết các chương trình hợp ngữ, thường gán cho các địa chỉ logic bằng các nhãn (label) hay các tên (name). Ví dụ: DATA SEGMENT SAMPLEB DB ? DATA ENDS sẽ gán nhãn SAMPLE cho byte ở địa chỉ logic 0 trong đoạn dữ liệu. Các phát biểu này không phải là các lệnh µP mà chỉ là các lệnh giả (pseudo instruction) dùng cho các chương trình dịch. Toán tử DATA SEGMENT báo cho chương trình dịch biết các lệnh theo sau sẽ nằm trong đoạn dữ liệu. Toán tử DB (Define Byte) gán cho nhãn SAMPLEB 1 byte trong đoạn dữ liệu. Ký hiệu ? xác định rằng không cần định nghĩa nội dung của byte đó. Do SAMPLEB là dòng đầu tiên nên nó sẽ có địa chỉ logic là 0. Phát biểu DATA ENDS kết thúc đoạn dữ liệu (ở đây chỉ dịnh nghĩa 1 byte). Trong trường hợp muốn định nghĩa 1 word, ta dùng toán tử DW (Define Word). VD: SAMPLEW DW 1000h Phát biểu này định nghĩa nhãn SAMPLEW ứng với vị trí word và nội dung của vị trí này là 1000h. Ngoài ra, ta có thể dùng các toán tử DD định nghĩa từ kép (double word), DQ định nghĩa từ bộ bốn (8 byte) và DT định nghĩa 10 byte. 3. Cách mã hoá lệnh Lệnh của bộ vi xử lý sẽ biểu diễn bằng các ký tự dưới dạng gợi nhớ (mnemonic) để có thể dễ dàng sử dụng. Đối với vi xử lý thì các lệnh được biểu diễn bằng các mã lệnh (opcode) nên sau khi nhận lệnh vi xử lý phải thực hiện giải mã lệnh rồi mới thực thi nó. Một lệnh vi xử lý có thể dài 1 byte hay nhiều byte. Nếu ta dùng 1 byte để mã hoá thì sẽ mã hoá được 256 lệnh khác nhau. Tuy nhiên do một lệnh không phải chỉ có một cách thực hiện nên ta không thể thực hiện đơn giản như trên. Để tìm hiểu cách mã hoá lệnh, ta xét lệnh MOV des,src dùng để chuyển dữ liệu giữa hai thanh ghi hay một ô nhớ và một thanh ghi. Lệnh MOV mã hoá như sau: Byte 1 Byte 2 Byte 3 Byte 4 1 0 0 0 1 0 Opcode D W Mod reg M/R Để mã hóa lệnh MOV, ta cần dùng ít nhất là 2 byte trong đó 6 bit dùng cho mã lệnh. Bit D xác định hướng truyền của dữ liệu, D = 0 xác định dữ liệu sẽ đi từ thanh ghi cho bởi 3 bit Reg, D = 1 xác định dữ liệu sẽ đi đến thanh ghi cho bởi 3 bit Reg. Bit W xác định sẽ truyền 1 byte (W = 0) hay 1 word (W = 1). 3 bit Reg dùng để chọn thanh ghi sử dụng: Phạm Hùng Kim Khánh Trang 39
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Bảng 2.10: Thanh ghi Mã W=1 W=0 000 AX AL 001 CX CL 010 DX DL 011 BX BL 100 SP AH 101 DI CH 110 BP DH 111 SI BH 2 bit mod và 3 bit R/M (Register / Memory) dùng để xác định chế độ địa chỉ cho các toán hạng của lệnh. Bảng 2.11: MOD 11 00 01 10 R/M W=1 W=0 000 [BX]+[SI] [BX]+[SI]+addr8 [BX]+[SI]+addr16 AX AL 001 [BX]+[DI] [BX]+[DI]+addr8 [BX]+[DI]+addr16 CX CL 010 [BP]+[SI] [BP]+[SI] +addr8 [BP]+[SI] +addr16 DX DL 011 [BP]+[DI] [BP]+[DI] +addr8 [BP]+[DI] +addr16 BX BL 100 [SI] [SI] +addr8 [SI] +addr16 SP AH 101 [DI] [DI] +addr8 [DI] +addr16 BP CH 110 addr16 [BP] +addr8 [BP] +addr16 SI DH 111 [BX] [BX] +addr8 [BX] +addr16 DI BH Tổng quát, 8086/8088 có khoảng 300 tác vụ có thể có trong tập lệnh của nó. Mỗi lệnh kéo dài từ 1 đến 6 byte. Từ ví dụ trên, ta thấy mã lệnh có các vùng: - Vùng mã lệnh (opcode): chứa mã lệnh của lệnh sẽ thực thi - Vùng thanh ghi (reg): chứa các thanh ghi sẽ thực hiện (bảng 2.10) - Vùng chế độ (mod): (bảng 2.11) 00: toán hạng bộ nhớ trực tiếp nếu R/M = 110, ngược lại là toán hạng gián tiếp 01: toán hạng gián tiếp, độ dời 8 bit 10: toán hạng gián tiếp, độ dời 16 bit 11: sử dụng 2 thanh ghi, vùng R/M sẽ là vùng Reg - Vùng thanh ghi / bộ nhớ R/M (Reg/Mem): (bảng 2.11) Phạm Hùng Kim Khánh Trang 40
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý 4. Các cách định địa chỉ Bảng 2.12: Cách định Mã đối Ví dụ địa chỉ tượng Từ gợi nhớ Đoạn Hoạt động Mô tả truy xuất Tức thời B80010 MOV AX,1000h Mã AH ← 10h (1) AL ← 00h Thanh ghi 8BD1 MOV DX,CX Trong µP DX ← CX (2) Trực tiếp 8A260010 MOV AH,[1000h] Döõ AH ← [1000h] (3) lieäu Gián tiếp 8B04 MOV AX,[SI] Dữ liệu AL ← [SI]; AH ←[SI+1] (4) thanh ghi FF25 JMP [DI] Dữ liệu IP←[DI+1:DI] FE4600 INC BYTE PTR [BP] Stack [BP]←[BP]+1 FF0F DEC WORD PTR [BX] Dữ liệu [BX+1:BX]← [BX+1:BX]-1 Có chỉ số 8B4406 MOV AX,[SI+6] Dữ liệu AL ← [SI+6]; AH ←[SI+7] (5) FF6506 JMP [DI+6] Dữ liệu IP←[DI+7:DI+6] Có nền 8B4602 MOV AX,[BP+2] Stack AL←[BP+2]; AH ←[BP+3] (6) FF6702 JMP [BP+2] Dữ liệu IP←[BX+3:BX+6] Có nền và 8B00 MOV AX,[BX+SI] Dữ liệu AL←[BX+SI];AH←[BX+SI+1] (7) có chỉ số FF21 JMP [BX+DI] Dữ liệu IP←[BX+DI+1:BX+DI] FE02 INC BYTE PTR [BP+SI] Stack [BP+SI]←[BP+SI]+1 FF0B DEC WORD PTR [BP+DI] Stack [BP+DI+1:BP+DI]← [BP+DI+1:BP+DI]-1 Có nền và 8B4005 MOV AX,[BX+SI+5] Dữ liệu AL←[BX+SI+5] (8) có chỉ số FF6105 AH←[BX+SI+1] với độ dời FE4205 JMP [BX+DI+5] Dữ liệu IP←[BX+DI+6:BX+DI+5] FF4B05 INC BYTE PTR [BP+SI+5] Stack [BP+SI+5]←[BP+SI+5]+1 DEC WORD PTR [BP+DI+5] Stack [BP+DI+6:BP+DI+5]← [BP+DI+6:BP+DI+5]-1 String A4 MOVSB Thêm, [ES:DI] ← [DS:DI] (9) dữ liệu Nếu DF = 0 thì SI ← SI + 1; DI ← DI + 1 Nếu DF = 1 thì SI ← SI - 1; DI ← DI - 1 - BYTE PTR và WORD PTR tránh lầm giữa truy xuất byte và word. - Độ dời được cộng vào thanh ghi con trỏ hay nền là số nhị phân dạng bù 2. - (1): nguồn dữ liệu trong lệnh - (2): đích và nguồn là các thanh ghi của µP - (3): địa chỉ bộ nhớ cung cấp trong lệnh - (4): địa chỉ bộ nhớ cung cấp trong thanh ghi con trỏ hay chỉ số - (5): địa chỉ bộ nhớ là tổng của thanh ghi chỉ số cộng với độ dời trong lệnh - (6): địa chỉ bộ nhớ là tổng của thanh ghi BX hay BP cộng với độ dời trong lệnh - (7): địa chỉ bộ nhớ là tổng của thanh ghi chỉ số và thanh ghi nền Phạm Hùng Kim Khánh Trang 41
CÓ THỂ BẠN MUỐN DOWNLOAD
-
Giáo trình kỹ thuật vi xử lý tập 1 part 2
54 p | 284 | 178
-
Chương 3: Tập lệnh của vi xử lý
144 p | 405 | 167
-
Giới thiệu chương trình kỹ thuật vi xử lý
11 p | 229 | 111
-
Phần chương trình viết trên vi xử lý
110 p | 321 | 99
-
Lập trình java căn bản - Chương 6: Lập trình Menu với AWT (tiếp)
30 p | 269 | 99
-
Chương 3 - Bộ Vi xử lý 8088
70 p | 218 | 87
-
Chương 10 - Các bộ vi xử lý tiên tiến của INTEL
12 p | 182 | 46
-
Chương 7 - Ngắt và xử lý ngắt trong hệ 8088
27 p | 124 | 44
-
Bài giảng Kỹ thuật vi xử lý (TS.Phạm Hoàng Duy) - Chương 1: Tổng quan hệ vi xử lý
30 p | 136 | 36
-
Kỹ thuật vi xử lý- chương 1:Tổng quan về vi xử lý và hệ xử lý
38 p | 57 | 20
-
Chương 9 - Một số phối ghép cơ bản
59 p | 68 | 18
-
Bài giảng Kỹ thuật vi xử lý và lập trình hợp ngữ
165 p | 35 | 16
-
Chương 2 - Máy tính trong hệ thống vi xử lý
8 p | 69 | 13
-
Bài giảng Vi xử lý – Vi điều khiển
222 p | 35 | 12
-
Tài liệu vi xử lý - Chương 3
30 p | 48 | 8
-
Bài giảng Vi xử lý: Phần 2 - Đại học Công nghiệp TP. HCM
99 p | 26 | 6
-
Bài giảng Ứng dụng vi điều khiển - Microcontroller Applications
56 p | 19 | 1

markdown:
# CHƯƠNG 2: TỔ CHỨC HỆ THỐNG VI XỬ LÝ
Chia sẻ: Ha Van Tien | Ngày: | Loại File: PDF | Số trang:22
lượt xem 12
download
![](http://image1.tailieu.vn/document/thumbnail/2010/20100417/hatien202/80x100/vi_xu_ly_2_0284.jpg)
##
CHƯƠNG 2: TỔ CHỨC HỆ THỐNG VI XỬ LÝ
[Vui lòng tải xuống để xem tài liệu đầy đủ](javascript:void(0);)
Download
![](http://static1.tailieu.vn/b2013az/templates/version1/default/images/down16x21.png)
Tất cả các máy vi tính IBM họ PC hoặc các máy vi tính tương thích IBM đều sử dụng µP Intel họ iAPX. Bảng 2.1 liệt kê các đặc tính cơ bản của một số µP của Intel trong đó 80486 chứa một bộ điều khiển cache tích hợp và 8 KB RAM tĩnh, Pentium chứa cache 16 KB RAM tĩnh. Bảng 2.1: Kiến trúc các µP của Intel 8 bit, 16 bit và 32 bit
Bình luận(0)
[Đăng nhập để gửi bình luận!](javascript:void(0);)
##
Nội dung Text: CHƯƠNG 2: TỔ CHỨC HỆ THỐNG VI XỬ LÝ
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý CHƯƠNG 2: TỔ CHỨC HỆ THỐNG VI XỬ LÝ 1. Giới thiệu Tất cả các máy vi tính IBM họ PC hoặc các máy vi tính tương thích IBM đều sử dụng µP Intel họ iAPX. Bảng 2.1 liệt kê các đặc tính cơ bản của một số µP của Intel trong đó 80486 chứa một bộ điều khiển cache tích hợp và 8 KB RAM tĩnh, Pentium chứa cache 16 KB RAM tĩnh. Bảng 2.1: Kiến trúc các µP của Intel 8 bit, 16 bit và 32 bit ĐẶC TÍNH 8080 8086 8088 80186 80188 80286 80386 386SX 486/Pentium Bus địa chỉ (số 8 16 8 16 8 16 32 16 32 bit) Đường dữ liệu 8 16 16 16 16 16 32 32 32/64 nội (số bit) Tốc độ (MHz) 2,2.6, 5,8,10 5,8 8,10, 8,10, 6,8,10, 16,20,25, 16 25-66 6.3 12.5 12.5 12.5,20 33 Thanh ghi đến 1.3 0.3 0.38 0.2 0.3 0.125 0.125 0.125 0.04 thanh ghi (µs/word) Đáp ứng 7.3 6.1 8.6 3.36 6.2 2.52 3.5 2.52 3.5 interrupt (µs) Địa chỉ bộ nhớ 64K 1M 1M 1M 1M 16M 4G 4G 4G Cách định địa 5 24 24 24 24 24 28 28 28 chỉ Coprocessor 0 8087 8087 8087 8087 80287 80287/ 80287/ On chip 80387 80387 Số thanh ghi 6 8 8 8 8 8 8 8 8 đa dụng Số thanh ghi 0 4 4 4 4 4 6 6 6 đoạn Điều khiển 8259- 8259 8259- On On 8259- 8259-A 82335 µPLD interrupt A -A A chip chip A Timer – 8253 8253 8253/ On On 8253/ 8253/5 8253/5 On chip counter /54 54 chip chip 54 4 4 2. µP 8086/8088 2.1. Mô tả 2.1.1. Định thì chu kỳ bus Mỗi chu kỳ bus bắt đầu bằng việc xuất địa chỉ bộ nhớ hoặc I/O port (chu kỳ xung nhịp T1). Với 8086 thì địa chỉ này có thể là địa chỉ bộ nhớ 20 bit, địa chỉ I/O gián tiếp 16 bit (thanh ghi DX) hay địa chỉ I/O trực tiếp 8 bit. Bus điều khiển có 4 tín hiệu tác động mức thấp là MEMR , MEMW , IOR và IOW . Phạm Hùng Kim Khánh Trang 22
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Các chuỗi sự kiện xảy ra trong một chu kỳ bus đọc bộ nhớ: T1: µP xuất địa chỉ bộ nhớ 20 bit. Các đường dữ liệu không hoạt động và các đường điều khiển bị cấm T2: Đường điều khiển MEMR xuống mức thấp. Đơn vị bộ nhớ ghi nhận chu kỳ bus này là quá trình đọc bộ nhớ và đặt byte hay word có địa chỉ đó lên data bus. T3: µP đặt cấu hình để các đường data bus là nhập. Trạng thái này chủ yếu để bộ nhớ có thời gian tìm kiếm byte hay word dữ liệu T4: µP đợi dữ liệu trên data bus. Do đó, nó thực hiện chốt data bus và giải phóng các đường điều khiển đọc bộ nhớ. Quá trình này sẽ kết thúc chu kỳ bus. T1 T2 T3 T4 Clk Address bus Địa chỉ ra IOR hay Đọc bộ nhớ hay MEMR I/O Data bus Dữ liệu ra Address Địa chỉ vào bus Ghi bộ IOW hay nhớ hay MEMW I/O Dữ liệu vào Data bus Hình 2.1 – Định thì chu kỳ bus Trong một chu kỳ bus, µP có thể thực hiện đọc I/O, ghi I/O, đọc bộ nhớ hay ghi bộ nhớ. Các đường address bus và control bus dùng để xác định địa chỉ bộ nhớ hay I/O và hướng truyền dữ liệu trên data bus. Chú ý rằng µP điều khiển tất cả các quá trình trên nên bộ nhớ bắt buộc phải cung cấp được dữ liệu vào lúc MEMR lên mức cao trong trạng thái T4. Nếu không, µP sẽ đọc dữ liệu ngẫu nhiên không mong muốn trên data bus. Để giải quyết vấn đề này, ta có thể dùng thêm các trạng thái chờ (wait state). Phạm Hùng Kim Khánh Trang 23
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý 2.1.2. Mô tả chân 1 40 2 GND VCC 39 3 AD14 AD15 38 4 AD13 A16/S3 37 5 AD12 A17/S4 36 6 AD11 A18/S5 35 7 AD10 A19/S6 34 8 AD9 BHE/S7 33 9 AD8 MN/MX 32 10 AD7 RD 31 11 AD6 HOLD (RQ/GT0) 30 12 AD5 HLDA (RQ/GT1) 29 13 AD4 WR (LOCK) 28 14 AD3 IO/M (S2) 27 15 AD2 DT/R (S1) 26 16 AD1 DEN (S0) 25 17 AD0 ALE (QS0) 24 18 NMI INTA (QS1) 23 19 INTR TEST 22 20 CLK READY 21 GND RESET 8086 Hình 2.2 – Sơ đồ chân của 8086 8086 có bus địa chỉ 20 bit, bus dữ liệu 16 bit, 3 chân nguồn và 17 chân dùng cho các chức năng điều khiển. Tuy nhiên, ta có thể dùng kỹ thuật ghép kênh thời gian (time multiplexing) để cho phép một chân có nhiều chức năng nên các chân sẽ được phân ra: - 16 chân dữ liệu và địa chỉ (AD0 ÷ AD15): các chân này sẽ là các đường địa chỉ trong trạng thái T1 và dữ liệu trong các trạng thái T2 – T4. - 4 chân địa chỉ và trạng thái - 3 chân nguồn - 17 chân định thì và điều khiển 8086 có thể hoạt động ở chế độ tối thiểu (minimum mode) hay chế độ tối đa (maximum mode). Chế độ tối thiểu chỉ dùng cho các hệ thống µP đơn giản còn chế độ tối đa dùng cho các hệ thống phúc tạp hơn giao tiếp với các bộ nhớ và I/O riêng. Phạm Hùng Kim Khánh Trang 24
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Các tín hiệu chung cho cả hai chế độ tối đa và tối thiểu: Bảng 2.2: Chân Chức năng Loại AD15 ÷ AD0 Bus dữ liệu / địa chỉ 2 chiều, 3 trạng thái A19/S6 ÷ A16/S3 Địa chỉ / trạng thái Ngõ ra 3 trạng thái MX Điều khiển chế độ Ngõ vào RD Điều khiển đọc Ngõ ra 3 trạng thái TEST Chờ kiểm tra điều khiển Ngõ vào READY Chờ trạng thái điều khiển Ngõ vào RESET Reset hệ thống Ngõ vào NMI Yêu cầu ngắt không thể che Ngõ vào INTR Yêu cầu ngắt Ngõ vào CLK Xung nhịp hệ thống Ngõ vào VCC +5V Ngõ vào GND GND Ngõ vào Các tín hiệu chỉ dùng trong chế độ tối thiểu: Bảng 2.3: Chân Chức năng Loại HOLD Yêu cầu giữ Ngõ vào HLDA Ghi nhận giữ Ngõ vào WR Điều khiển ghi Ngõ ra 3 trạng thái IO/ M Điều khiển I/O và bộ nhớ Ngõ ra 3 trạng thái DT/ R Truyền / nhận dữ liệu Ngõ ra 3 trạng thái DEN Cho phép dữ liệu Ngõ ra 3 trạng thái BHE /S7 Đường trạng thái Ngõ ra 3 trạng thái ALE Cho phép chốt địa chỉ Ngõ ra INTA Ghi nhận ngắt Ngõ ra Các tín hiệu chỉ dùng trong chế độ tối đa: Bảng 2.4: Chân Chức năng Loại RQ / GT1,0 Yêu cầu / cấp bus 2 chiều LOCK Điều khiển khóa ưu tiên bus Ngõ ra 3 trạng thái S2 ÷ S0 Trạng thái chu kỳ bus Ngõ ra 3 trạng thái QS1, QS2 Trạng thái hàng lệnh Ngõ ra Phạm Hùng Kim Khánh Trang 25
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Trạng thái bus: Bảng 2.5: Ngõ vào trạng thái Chu kỳ CPU S2 S1 S0 0 0 0 Ghi nhận ngắt 0 0 1 Đọc I/O port 0 1 0 Ghi I/O port 0 1 1 Ngừng 1 0 0 Nhận lệnh 1 0 1 Đọc bộ nhớ 1 1 0 Ghi bộ nhớ 1 1 1 Thụ động Trạng thái hàng lệnh: Bảng 2.6: QS1 QS0 Trạng thái hàng lệnh 0 0 Không hoạt động 0 1 Lấy byte đầu tiên của lệnh 1 0 Hàng rỗng 1 1 Lấy byte kế tiếp Nguồn cung cấp và xung nhịp (VCC, GND và CLK): - 8086 sử dụng nguồn cấp điện +5V và có 2 chân đất. - Dòng điện cực đại là 340 mA (10 mA cho loại CMOS). - Xung nhịp dùng dạng xung chữ nhật có chu kỳ với thời gian cạnh lên và xuống nhỏ hơn 10 ns. - Tiêu hao công suất và tần số xung nhịp cực đại: Các chân trạng thái trong chế độ tối đa (S0, S1 và S2 - status): Các chân này sử dụng bởi bộ điều khiển bus 8288 để tạo các tín hiệu điều khiển như bảng 2.5. Các chân điều khiển bus (HOLD, HLDA, RQ / GT0 , RQ / GT1 , LOCK ): Chế độ tối thiểu: - HOLD (giữ): ngõ vào tác động mức cao làm cho µP hở mạch tất cả các bus của nó, tách µP khỏi bộ nhớ của nó và I/O để cho phép thiết bị khác xử lý Phạm Hùng Kim Khánh Trang 26
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý bus hệ thống. Quá trình này gọi là truy xuất bộ nhớ trực tiếp (DMA – Direct Memory Access). - HLDA (Hold acknowledge): ghi nhận yêu cầu DMA đối với bộ điều khiển DMA. Chế độ tối đa: - RQ / GT0 , RQ / GT1 (Request / Grant): các chân này dùng cả hai chức năng vào (nhận yêu cầu) và ra (chấp nhận yêu cầu). Khi một thiết bị muốn lấy điều khiển của bus cục bộ, nó sẽ phát yêu cầu bằng cách đưa tín hiệu mức thấp vào chân yêu cầu. Sau khi nhận yêu cầu, 8086 sẽ ở trạng thái HOLD và gởi tín hiệu chấp nhận ra chân này. Ở đây, chân RQ / GT0 có độ ưu tiên cao hơn chân RQ / GT1 . - LOCK : báo cho các thiết bị khác biết không thể lấy điều khiển của bus cục bộ. Các chân ngắt (NMI, INTR và INTA ): INTR và NMI là các yêu cầu ngắt khởi động bằng phần cứng, làm việc chính xác như các ngắt mềm. NMI (Non-Maskable Interrupt) là ngõ vào tác động cạnh lên. NMI là ngắt không thể che được và luôn được phục vụ, thường dùng cho các sự kiện như hư nguồn hay các lỗi bộ nhớ. INTR tác động mức cao và có thể bị che bằng cách xoá cờ IF trong thanh ghi cờ (xem 2.3.4) bằng lệnh CLI. Khi NMI tích cực, điều khiển sẽ được chuyển đến địa chỉ chứa trong các vị trí 00008h ÷ 0000Bh. Khi INTR tích cực, chu kỳ ghi nhận ngắt (interrupt acknowledge cycle) được thực hiện. Quá trình này giống như chu kỳ đọc bộ nhớ ngoại trừ INTA tích cực thay vì RD . Thiết bị tạo ngắt sẽ đặt một giá trị 8 bit vào data bus và chuyển điều khiển đến vị trí giá trị × 4 đến giá trị × 4 + 3. Chân RESET: hoạt động khi có xung tác động mức cao, dùng để khởi động lại (P. Sau khi khởi động, (P sẽ đọc lệnh tại địa chỉ FFFF0h. RESET được sử dụng khi hệ thống có sự cố. Các chân điều khiển bus (READY, RD , ALE, DEN , DT/ R , WR và IO/ M ): Trong các chân điều khiển này, chỉ có hai chân READY và RD làm việc ở chế độ tối đa. - Chân READY: ngõ vào READY được lấy mẫu ở cạnh lên của xung nhịp T2. Nếu chân này ở mức thấp (không sẵn sàng) thì sẽ thêm vào một chu kỳ T3 nữa. Chu trình này sẽ tiếp tục cho đến khi nào chân READY lên mức cao. Ngõ vào này thường được điều khiển bởi thiết bị bộ nhớ chậm, không thể cung cấp dữ liệu kịp thời cho µP. - Chân IO/ M (IO/Memory – Xuất nhập /Bộ nhớ): xác định chu kỳ bus hiện hành làm việc với bộ nhớ (mức thấp) hay I/O (mức cao). Phạm Hùng Kim Khánh Trang 27
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý - Chân RD (Read): tín hiệu tác động mức thấp chỉ chiều truyền dữ liệu từ bộ nhớ hay I/O đến µP. Ta có thể kết hợp với tín hiệu này với IO/ M để tạo các tín hiệu MEMR và IOR . Nó được xuất ra trong trạng thái T2 và lấy đi trong trạng thái T4. Thiết bị bộ nhớ hay I/O giả sử là đã đặt byte hay word vào các đường dữ liệu khi RD trở về mức cao. - Chân WR (Write): tín hiệu này ngược với RD , nó xác định chiều truyền dữ liệu từ µP đến I/O hay bộ nhớ. RD 1 2 1 MEMR 3 2 1 IOR 3 IO/ M 1 2 2 1 3 IOW 2 1 3 MEMW WR 1 2 2 Hình 2.3 – Tạo tín hiệu điều khiển bộ nhớ và I/O - Chân ALE (Address Latch Enable - cho phép chốt địa chỉ): tín hiệu ra trên chân này có thể dùng để phân kênh các đường địa chỉ, dữ liệu và trạng thái trên AD0 ÷ AD15, A16/S3 ÷ A19/S6 và BHE /S7. Mọi chu kỳ bắt đầu với xung ALE trong trạng thái T1. Địa chỉ 20 bit được bảo đảm sẽ hợp lệ khi ALE chuyển từ mức cao xuống mức thấp. - Chân DEN (Data Enable – cho phép dữ liệu): tín hiệu này được dùng với DT/ R để cho phép nối các bộ đệm hai chiều vào data bus. Nó ngăn ngừa sự tranh chấp bus bằng cách cấm các bộ đệm dữ liệu cho đến trạng thái T2 khi các đường dữ liệu / địa chỉ không còn lưu trữ địa chỉ của bộ nhớ hay I/O. - Chân DT/ R (Data transmit/receive – truyền/nhận dữ liệu): dùng để điều khiển chiều của luồng dữ liệu qua các bộ đệm (nếu có) vào bus dữ liệu của hệ thống. Khi ở mức thấp, nó chỉ thực hiện tác vụ đọc và khi ở mức cao nó chỉ thực hiện tác vụ ghi. Phạm Hùng Kim Khánh Trang 28
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý T1 T2 T3 T4 Clk ALE IO/ M Địa chỉ / trạng thái A16 ÷ A19, BHE S3 ÷ S7 Dữ liệu vào AD0 ÷ AD15 A0 ÷ A15 D0 ÷ D15 Chu kỳ RD đọc DT/ R DEN AD0 ÷ AD15 A0 ÷ A15 Döõ lieäu ra D0 ÷ D15 Chu kỳ RD ghi DT/ R DEN Hình 2.4 – Các chu kỳ đọc và ghi của 8086 Các chân trạng thái (AD16/S3 ÷ AD19/S6 và BHE /S7): 5 tín hiệu trạng thái này được xuất ra trong các trạng thái T2 ÷ T4, dùng cho các mục đích kiểm tra. Bit S7 là bit trạng thái dư (không dùng), bit S6 luôn bằng 0, S5 mô tả trạng thái của cờ ngắt IF còn S3, S4 dùng để xác định đoạn đang sử dụng: Bảng 2.7: S4 S3 Đoạn 0 0 Thêm 0 1 Stack 1 0 Mã (hay không) 1 1 Dữ liệu Phạm Hùng Kim Khánh Trang 29
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Tín hiệu BHE /S7 (Bus High Enable) chỉ được xuất trong trạng thái T1. Khi chân này ở mức thấp, nó sẽ chỉ AD8 ÷ AD15 liên quan đến việc truyền dữ liệu. Quá trình này có thể xảy ra đối với các truy xuất bộ nhớ, I/O hay truy xuất 1 byte dữ liệu từ địa chỉ lẻ. Bus dữ liệu (AD0 ÷ AD15): 16 chân này tạo thành bus dữ liệu hai chiều. Các đường này chỉ hợp lệ trong các trạng thái T2 ÷ T4. Trong trạng thái T1, chúng giữ 16 bit thấp của địa chỉ bộ nhớ hoặc I/O. Bus địa chỉ (AD0 ÷ AD15 và AD16/S3 ÷ AD19/S6): 20 chân này tương ứng với bus địa chỉ 20 bit và cho phép µP truy xuất 1 MB vị trí bộ nhớ. Các đường ra này chỉ hợp lệ trong trạng thái T1, chuyển thành các đường dữ liệu và trạng thái trong trạng thái T2 ÷ T4. Chọn chế độ MX : Chân này dùng để chọn chế độ hoạt động cho 8086, nếu ở mức cao thì sẽ hoạt động ở chế độ tối thiểu còn ở mức thấp thì sẽ hoạt động ở chế độ tối đa. 2.2. Kiến trúc nội µP có khả năng thực hiện các tác vụ dữ liệu theo tập lệnh bên trong. Một lệnh được ghi nhận bằng mã đã được định nghĩa trước, gọi là mã lệnh (opcode). Trước khi thực thi một lệnh, µP phải nhận được mã lệnh từ bộ nhớ chương trình của nó. Quá trình xử lý này gọi là chu kỳ nhận lệnh (fetch cycle). Một khi các mã được nhận và được giải mã thì mạch bên trong µP có thể tiến hành thực thi (execute) mã lệnh. BIU EU ← Hàng lệnh ← Bus hệ thống Hình 2.5 – Kiến trúc nội của µP 8086 BIU (Bus Interface Unit – đơn vị giao tiếp bus) nhận các mã lệnh từ bộ nhớ và đặt chúng vào hàng chờ lệnh. EU (Execute Unit – đơn vị thực thi) sẽ giải mã và thực hiện các lệnh trong hàng. Chú ý rằng các đơn vị EU và BIU làm việc độc lập với nhau nên BIU có khả năng đang nhận một lệnh mới trong khi EU dang thực thi lệnh trước đó. Khi EU đã thực hiện xong lệnh, nó sẽ lấy mã lệnh kế tiếp trong hàng đợi lệnh (instruction queue). Phạm Hùng Kim Khánh Trang 30
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Kiến trúc nội của µP 8086 ở hình 2.2. Nó có 2 bộ xử lý riêng: BIU và EU. BIU cung cấp các chức năng phần cứng, bao gồm tạo các địa chỉ bộ nhớ và I/O để chuyển dữ liệu giữa EU và bên ngoài µP. BIU EU Điều khiển bus và sinh địa chỉ Σ AH AL 5 BH BL 4 CH CL 3 DH DL CS 2 BP ES 1 DI SS SI DS SP IP Internal bus Thanh ghi cờ ALU Hình 2.6 – Kiến trúc nội của 8086 EU nhận các mã lệnh chương trình và dữ liệu từ BIU, thực thi các lệnh này và chứa các kết quả trong các thanh ghi. Ngoài ra, dữ liệu cũng có thể chứa trong một vị trí bộ nhớ hay được ghi vào thiết bị xuất. Chú ý rằng EU không có bus hệ thống nên phải thực hiện nhận và xuất tất cả các dữ liệu của nó thông qua BIU. Sự khác biệt giữa µP 8086 và 8088 là BIU. Trong 8088, đường bus dữ liệu là 8 bit trong khi của 8086 là 16 bit. Ngoài ra hàng lệnh của 8088 dài 4 byte trong khi của 8086 là 6 byte. Phạm Hùng Kim Khánh Trang 31
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Tuy nhiên do EU giữa hai loại µP này giống nhau nên các chương trình viết cho 8086 có thể chạy được trên 8088 mà không cần thay đổi gì cả. Quá trình nhận lệnh và thực thi lệnh: 1/ BIU xuất nội dung của thanh ghi con trỏ lệnh IP (Instruction Pointer) ra bus địa chỉ để chọn byte hay word đọc vào BIU. 2/ Thanh ghi IP được tăng thêm 1 để chuẩn bị nhận lệnh kế. 3/ Khi lệnh ở trong BIU, nó được đưa sang hàng lệnh (queue). Đây là một thanh ghi lưu trữ dạng FIFO (First In First Out – Vào trước ra trước), dùng cơ chế xử lý xen kẽ liên tục các dòng mã lệnh (kỹ thuật đường ống – pipelining). 4/ Giả sử ban đầu hàng lệnh trống, EU sẽ không làm gì cả cho đến khi bắt đầu xuất hiện một lệnh trong hàng, EU sẽ lấy lệnh ra khỏi hàng và bắt đầu thực thi lệnh đó. 5/ Trong khi EU đang thực thi lệnh, BIU tiến hành nhận lệnh mới. Tuỳ theo thời gian thực thi lệnh mà BIU có thể đưa vào hàng lệnh nhiều lệnh mới trước khi EU thực hiện lệnh xong và tiếp tục lấy lệnh mới. BIU được lập trình để có thể nhận một lệnh mới bất kỳ lúc nào hàng lệnh có chỗ cho 1 byte (8088) hay 2 byte (8086). Lợi ích của phương pháp xử lý theo cơ chế pipeline là EU có thể thực thi các lệnh gần như liên tục thay vì phải đợi BIU nhận thêm lệnh mới. Nhận Thực thi Nhận Thực thi Nhận Thực thi (a) Nhận (1) Nhận (2) Nhận (3) Đọc Nhận (4) Nhận (4) Nhận Chờ Thực thi Chờ Thực thi Thực thi Thực thi Chờ Nhận (b) (1): lệnh thực thi không cần dữ liệu trong hàng (2): lệnh thực thi cần dữ liệu trong hàng (3): lệnh nhảy (4): các lệnh bị bỏ qua do lệnh nhảy Hình 2.7 (a) µP thông thường dùng chu kỳ nhận và thực thi lệnh tuần tự (b) kiến trúc dạng pipeline của 8086/8088 cho phép thực thi các lệnh mà không bị trễ do quá trình nhận lệnh Có 3 điều kiện làm cho EU ở chế độ chờ: - Điều kiện thứ nhất xảy ra khi lệnh cần truy xuất đến một vị trí bộ nhớ không ở trong hàng. BIU phải treo quá trình nhận lệnh và xuất ra địa chỉ của ô nhớ này. Sau khi truy xuất bộ nhớ, EU có thể tiếp tục quá trình thực thi lệnh từ hàng lệnh và BIU có thể tiếp tục đưa các lệnh vào hàng. Phạm Hùng Kim Khánh Trang 32
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý - Điều kiện thứ hai xảy ra khi lệnh được thực thi là lệnh nhảy (jump). Trong trường hợp này, thay vì dùng địa chỉ lệnh kế tiếp, ta phải chuyển đến địa chỉ mới (không tuần tự). Tuy nhiên, BIU vẫn luôn đặt các lệnh theo tuần tự và do đó sẽ lưu các lệnh không sử dụng. Trong khi nhận lệnh kế tiếp tại địa chỉ do lệnh jump chỉ đến, EU phải đợi và tất cả các byte trong hàng phải bỏ. - Điều kiện thứ ba có thể làm BIU treo quá trình nhận lệnh đó là khi thực thi các lệnh có thời gian thực thi lớn. Giả sử như lệnh AAM (ASCII Adjust for Multiplication) cần 83 chu kỳ xung nhịp để hoàn tất trong khi đó với 4 chu kỳ xung nhịp cho quá trình nhận lệnh thì hàng sẽ bị đầy. Như vậy BIU phải đợi cho đến khi lệnh được thực hiện xong và EU nhận mã lệnh từ hàng thì mới có thể tiếp tục quá trình nhận lệnh. 2.3. Các thanh ghi µP 8086/8088 có tất cả 14 thanh ghi nội. Các thanh ghi này có thể phân loại như sau: - Thanh ghi dữ liệu (data register) - Thanh ghi chỉ số và con trỏ (index & pointer register) - Thanh ghi đoạn (segment register) - Thanh ghi trạng thái và điều khiển (status & control register) 2.3.1. Các thanh ghi dữ liệu Các thanh ghi dữ liệu gồm có các thanh ghi 16 bit AX, BX, CX và DX trong đó nửa cao và nửa thấp của mỗi thanh ghi có thể định địa chỉ một cách độc lập. Các nửa thanh ghi này (8 bit) có tên là AH và AL, BH và BL, CH và CL, DH và DL. Các thanh ghi này được sử dụng trong các phép toán số học và logic hay trong quá trình chuyển dữ liệu. Bảng 2.8: Thanh ghi Sử dụng trong AX MUL, IMUL (toán hạng nguồn kích thước word) DIV, IDIV (toán hạng nguồn kích thước word) IN (nhập word) OUT (xuất word) CWD Các phép toán xử lý chuỗi (string) AL MUL, IMUL (toán hạng nguồn kích thước byte) DIV, IDIV (toán hạng nguồn kích thước byte) IN (nhập byte) OUT (xuất byte) XLAT AAA, AAD, AAM, AAS (các phép toán ASCII) CBW (đổi sang word) DAA, DAS (số thập phân) Các phép toán xử lý chuỗi (string) Phạm Hùng Kim Khánh Trang 33
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý AH MUL, IMUL (toán hạng nguồn kích thước byte) DIV, IDIV (toán hạng nguồn kích thước byte) CBW (đổi sang word) BX XLAT CX LOOP, LOOPE, LOOPNE Các phép toán string với tiếp dầu ngữ REP CL RCR, RCL, ROR, ROL (quay với số đếm byte) SHR, SAR, SAL (dịch với số đếm byte) DX MUL, IMUL (toán hạng nguồn kích thước word) DIV, IDIV (toán hạng nguồn kích thước word) AX (ACC – Accumulator): thanh ghi tích luỹ BX (Base): thanh ghi cơ sở CX (Count): đếm DX (Data): thanh ghi dữ liệu 2.3.2. Các thanh ghi chỉ số và con trỏ Bao gồm các thanh ghi 16 bit SP, BP, SI và DI, thường chứa các giá trị offset (độ lệch) cho các phần tử định địa chỉ trong một phân đoạn (segment). Chúng có thể được sử dụng trong các phép toán số học và logic. Hai thanh ghi con trỏ (SP – Stack Pointer và BP – Base Pointer) cho phép truy xuất dễ dàng đến các phần tử đang ở trong ngăn xếp (stack) hiện hành. Các thanh ghi chỉ số (SI – Source Index và DI – Destination Index) được dùng để truy xuất các phần tử trong các đoạn dữ liệu và doạn thêm (extra segment). Thông thường, các thanh ghi con trỏ liên hệ đến đoạn stack hiện hành và các thanh ghi chỉ số liên hệ đến doạn dữ liệu hiện hành. SI và DI dùng trong các phép toán chuỗi. 2.3.3. Các thanh ghi đoạn Bao gồm các thanh ghi 16 bit CS (Code segment), DS (Data segment), SS (stack segment) và ES (extra segment), dùng để định địa chỉ vùng nhớ 1 MB bằng cách chia thành 16 đoạn 64 KB. Tất cả các lệnh phải ở trong đoạn mã hiện hành, được định địa chỉ thông qua thanh ghi CS. Offset (độ lệch) của mã được xác định bằng thanh ghi IP. Dữ liệu chương trình thường được đặt ở đoạn dữ liệu, định vị thông qua thanh ghi DS. Stack định vị thông qua thanh ghi SS. Thanh ghi đoạn thêm có thể sử dụng để định địa chỉ các toán hạng, dữ liệu, bộ nhớ và các phần tử khác ngoài đoạn dữ liệu và stack hiện hành. 2.3.4. Các thanh ghi điều khiển và trạng thái Thanh ghi con trỏ lệnh IP (Instruction Pointer) giống như bộ đếm chương trình (Program Counter). Thanh ghi điều khiển này do BIU quản lý nhằm lưu trữ offset từ bắt đầu đoạn mã đến lệnh thực thi kế tiếp. Ta không thể xử lý trực tiếp trên thanh ghi IP. Thanh ghi cờ (Flag register) hay từ trạng thái 16 bit chứa 3 bit điều khiển (TF, IF và DF) và 6 bit trạng thái (OF, SF, ZF, AF, PF và CF) còn các bit còn lại mà 8086/8088 không sử dụng thì không thể truy xuất được. Phạm Hùng Kim Khánh Trang 34
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý 15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0 X X X X OF DF IF TF SF ZF X AF X PF X CF - OF (Overflow - tràn): OF = 1 xác định tràn số học, xảy ra khi kết quả vượt ra ngoài phạm vi biểu diễn - DF (Direction- hướng): xác định hướng chuyển string, DF = 1 khi µP làm việc với string theo thứ tự từ phải sang trái. - IF (Interrupt - ngắt): cho phép hay cấm các interrupt có mặt nạ - TF (Trap - bẫy): đặt µP vào chế độ từng bước, dùng cho các chương trình gỡ rối (debugger). - SF (Sign - dấu): dùng để chỉ các kết quả số học là số dương (SF = 0) hay âm (SF = 1). - ZF (Zero): = 1 nếu kết quả của phép toán trước là 0. - AF (Auxiliary – nhớ phụ): dùng trong các số thập phân để chỉ nhớ từ nửa byte thấp hay mượn từ nửa byte cao. - PF (Parity): PF = 1 nếu kết quả của phép toán là có tổng số bit 1 là chẵn (dùng để kiểm tra lỗi truyền dữ liệu) - CF (Carry): CF = 1 nếu có nhớ hay mượn từ bit cao nhất của kết quả. Cờ này cũng dùng cho các lệnh quay. 2.4. Phân đoạn bộ nhớ Ta biết rằng dù 8086 là µP 16 bit (có bus dữ liệu 16 bit) nhưng vẫn dùng bộ nhớ theo các byte. Điều này cho phép µP làm việc với byte cũng như word, nó rất quan trọng trong giao tiếp với các thiết bị I/O như máy in, thiết bị đầu cuối và modem (chúng được thiết kế để chuyển dữ liệu mã hoá ASCII 7 hay 8 bit). Ngoài ra, nhiều mã lệnh của 8086/8088 có chiều dài 1 byte nên cần phải truy xuất được các byte riêng biệt để có thể xử lý các lệnh này. 8086/8088 có bus địa chỉ 20 bit nên có thể cho phép truy xuất 220 = 1048576 địa chỉ bộ nhớ khác nhau. Byte 1048575 Word 524287 Byte 1048574 Byte 1 Word 0 Byte 0 Hình 2.8 – Vùng nhớ của 8086/8088 có 1048576 byte hay 524288 word Để thực hiện đọc 16 bit từ bộ nhớ, 8086 sẽ thực hiện đọc đồng thời byte có địa chỉ lẻ và byte có địa chỉ chẵn. Do đó, 8086 tổ chức bộ nhớ thành các bank chẵn và lẻ. Theo hình 2.8, ta có thể thấy rằng các word luôn bắt đầu tại địa chỉ chẵn nhưng ta vẫn Phạm Hùng Kim Khánh Trang 35
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý có thể đọc word có địa chỉ lẻ bằng cách thực hiện 2 chu kỳ đọc bộ nhớ: một chu kỳ đọc byte thấp và một chu kỳ đọc byte cao. Điều này sẽ làm chậm tốc độ xử lý. Đối với 8088 thì do bus dữ liệu 8 bit nên dù word có địa chỉ chẵn hay lẻ, nó cũng cần phải thực hiện 2 chu kỳ đọc hay ghi bộ nhớ và giao tiếp với bộ nhớ như một bank. Byte 1048574 Byte 1048575 Byte 1048575 Byte 1048572 Byte 1048573 Byte 1048574 Byte 2 Byte 3 Byte 3 Byte 0 Byte 1 Byte 2 Đọc lần 2 Byte 1 Đọc lần 1 Byte 0 Word dữ liệu 16 bit Hình 2.9 – Đọc word địa chỉ chẵn và địa chỉ lẻ Ngoài ra bộ nhớ cũng chia thành 16 khối, mỗi khối có kích thước 64 KB, bắt đầu ở địa chỉ 00000h và kết thúc ở FFFFFh. Địa chỉ bắt đầu mỗi khối sẽ tăng lên 1 ở số hex có ý nghĩa nhiều nhất khi thay đổi từ khối này sang khối kia. Ví dụ như khối 00000h → 10000h → 20000h … FFFFFh FFFFFh Dự trữ FFFFBh F0000h Dành riêng FFFF0h 0007Fh Dự trữ 20000h 10000h 00013h Dành riêng 00000h 00000h Hình 2.10 – Bảng bộ nhớ cho 8086/8088 Phạm Hùng Kim Khánh Trang 36
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Các thanh ghi phân đoạn: 8086/8088 định nghĩa 4 khối bộ nhớ 64KB: đoạn mã (code segment) giữ các mã lệnh chương trình, đoạn ngăn xếp (stack segment) lưu các địa chỉ sẽ trả về từ các chương trình con (subroutine) hay trình phục vụ ngắt (interrupt subroutine), đoạn dữ liệu (data segment) lưu trữ dữ liệu cho chương trình và đoạn thêm (extra segment) thường dùng cho các dữ liệu dùng chung. Các thanh ghi đoạn (CS, DS, SS và ES) dùng để chỉ vị trí nền của mỗi đoạn. Các thanh ghi này có 16 bit trong khi địa chỉ bộ nhớ là 20 bit nên để xác dịnh vị trí bộ nhớ, ta sẽ thêm 4 bit 0 vào các bit thấp của thanh ghi đoạn. Giả sử như thanh ghi CS chứa giá trị 1111h thì nó sẽ chỉ tới địa chỉ nền là 11110h. Chú ý rằng địa chỉ bắt đầu một đoạn không thể tuỳ ý mà phải bắt đầu tại một địa chỉ chia hết cho 16. Nghĩa là 4 bit thấp phải là 0. Ta cũng chú ý rằng 4 đoạn có thể không tách rời nhau mà chồng lấp lên nhau và ta cũng có thể cho 4 giá trị của các thanh ghi đoạn bằng nhau nghĩa là 4 đoạn này trùng nhau. VD: Thanh ghi DS có giá trị là 1000h thì địa chỉ nền là 10000h. Địa chỉ kết thúc tìm được bằng cách cộng địa chỉ nền với giá trị FFFFh (64K) → địa chỉ kết thúc là 10000h + FFFFh = 1FFFFh. Như vậy đoạn dữ liệu có địa chỉ từ 10000h = 1FFFFh. Các vị trí bộ nhớ không được định nghĩa trong các đoạn hiện hành không thể truy xuất được. Muốn truy xuất đến các vị trí đó, ta phải định nghĩa lại một trong các thanh ghi đoạn sau cho đoạn phải chứa vị trí đó. Như vậy, tại một thời điểm bất kỳ ta chỉ có thể truy xuất tối đa 4 × 64 KB = 256 KB bộ nhớ. Nội dung của các thanh ghi đoạn chỉ có thể xác định thông qua phần mềm. VD: Giả sử các thanh ghi đoạn có các giá trị CS = 2800h, DS = E000h, SS = 2900h và ES = 1000h. Ta có vị trí các đoạn trong bảng bộ nhớ như sau: EFFFFh Đoạn dữ liệu E0000h 38FFFh Đoạn stack 29000h ÷ 38FFFh 37FFFh 29000h Đoạn mã 28000h ÷ 37FFFh 28000h 1FFFFh Đoạn thêm 10000h Hình 2.11 – Vị trí các phân đoạn theo giá trị các thanh ghi đoạn Phạm Hùng Kim Khánh Trang 37
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Địa chỉ logic và địa chỉ vật lý: Các địa chỉ trong một đoạn thay đổi từ 0000h ÷ FFFFh, tương ứng với chiều dài đoạn là 64 KB. Một địa chỉ trong một đoạn được gọi là địa chỉ logic hay offset. Ví dụ như địa chỉ logic 0010h của đoạn mã trong hình 2.11 sẽ có địa chỉ thật sự là 28000h + 0010h = 28010h. Địa chỉ này gọi là địa chỉ vật lý. Như vậy, địa chỉ vật lý chính là địa chỉ thật sự xuất hiện ở bus địa chỉ, nó có chiều dài 20 bit còn địa chỉ logic là độ lệch (offset) từ vị trí 0 của một đoạn cho trước. VD: Giả sử xét các đoạn như hình 2.11. Địa chỉ vật lý tương ứng với địa chỉ logic 1000h trong đoạn stack là: 29000h + 1000h = 2A000h Địa chỉ vật lý tương ứng với địa chỉ logic 2000h trong đoạn mã là: 28000h + 2000h = 2A000h Ta thấy rằng có thể địa chỉ vật lý trùng nhau khi địa chỉ logic khác nhau nghĩa là một địa chỉ vật lý có thể có nhiều địa chỉ logic khác nhau. Để chỉ địa chỉ logic 1000h trong đoạn mã, ta dùng ký hiệu CS:1000h. Tương tự như vậy cho các đoạn khác, nghĩa là địa chỉ logic 1111h trong đoạn dữ liệu sẽ là DS:1111h. Mọi lệnh tham chiếu bộ nhớ sẽ có một thanh ghi đoạn mặc nhiên. Thanh ghi IP cung cấp địa chỉ offset khi truy xuất đến đoạn mã và BP cho đoạn stack. Ví dụ như IP = 1000h và CS = 2000h thì BIU sẽ truy xuất đến địa chỉ 20000h + 1000h = 21000h và nhận byte tại vị trí này. Bảng 2.9: Tham chiếu bộ nhớ Đoạn mặc nhiên Đoạn khác Offset Nhận lệnh CS Không IP Tác vụ stack SS Không SP Dữ liệu tổng quát DS CS,ES,SS Địa chỉ hiệu dụng Nguồn của string DS CS,ES,SS SI Đích của string ES Không DI BX dùng làm con trỏ DS CS,ES,SS Địa chỉ hiệu dụng BP dùng làm con trỏ SS CS,ES,SS Địa chỉ hiệu dụng VD: Ta sử dụng lệnh MOV [BP],AL với BP = 2C00h. Ở đây BP dùng làm con trỏ nên dùng đoạn stack. Giả sử các phân đoạn như hình 2.11 thì địa chỉ vật lý sẽ là 29000h + 2C00h = 2BC00h Định nghĩa các vị trí bộ nhớ: Thông thường ít khi nào ta cần biết đến địa chỉ vật lý của một vị trí bộ nhớ mà ta chỉ quan tâm đến địa chỉ logic của nó mà thôi. Lý do là vì địa chỉ vật lý còn phải phụ thuộc vào nội dung của các thanh ghi đoạn ngay cả khi địa chỉ logic giữ không đổi như đã xét ở trên. Phạm Hùng Kim Khánh Trang 38
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Khi viết các chương trình hợp ngữ, thường gán cho các địa chỉ logic bằng các nhãn (label) hay các tên (name). Ví dụ: DATA SEGMENT SAMPLEB DB ? DATA ENDS sẽ gán nhãn SAMPLE cho byte ở địa chỉ logic 0 trong đoạn dữ liệu. Các phát biểu này không phải là các lệnh µP mà chỉ là các lệnh giả (pseudo instruction) dùng cho các chương trình dịch. Toán tử DATA SEGMENT báo cho chương trình dịch biết các lệnh theo sau sẽ nằm trong đoạn dữ liệu. Toán tử DB (Define Byte) gán cho nhãn SAMPLEB 1 byte trong đoạn dữ liệu. Ký hiệu ? xác định rằng không cần định nghĩa nội dung của byte đó. Do SAMPLEB là dòng đầu tiên nên nó sẽ có địa chỉ logic là 0. Phát biểu DATA ENDS kết thúc đoạn dữ liệu (ở đây chỉ dịnh nghĩa 1 byte). Trong trường hợp muốn định nghĩa 1 word, ta dùng toán tử DW (Define Word). VD: SAMPLEW DW 1000h Phát biểu này định nghĩa nhãn SAMPLEW ứng với vị trí word và nội dung của vị trí này là 1000h. Ngoài ra, ta có thể dùng các toán tử DD định nghĩa từ kép (double word), DQ định nghĩa từ bộ bốn (8 byte) và DT định nghĩa 10 byte. 3. Cách mã hoá lệnh Lệnh của bộ vi xử lý sẽ biểu diễn bằng các ký tự dưới dạng gợi nhớ (mnemonic) để có thể dễ dàng sử dụng. Đối với vi xử lý thì các lệnh được biểu diễn bằng các mã lệnh (opcode) nên sau khi nhận lệnh vi xử lý phải thực hiện giải mã lệnh rồi mới thực thi nó. Một lệnh vi xử lý có thể dài 1 byte hay nhiều byte. Nếu ta dùng 1 byte để mã hoá thì sẽ mã hoá được 256 lệnh khác nhau. Tuy nhiên do một lệnh không phải chỉ có một cách thực hiện nên ta không thể thực hiện đơn giản như trên. Để tìm hiểu cách mã hoá lệnh, ta xét lệnh MOV des,src dùng để chuyển dữ liệu giữa hai thanh ghi hay một ô nhớ và một thanh ghi. Lệnh MOV mã hoá như sau: Byte 1 Byte 2 Byte 3 Byte 4 1 0 0 0 1 0 Opcode D W Mod reg M/R Để mã hóa lệnh MOV, ta cần dùng ít nhất là 2 byte trong đó 6 bit dùng cho mã lệnh. Bit D xác định hướng truyền của dữ liệu, D = 0 xác định dữ liệu sẽ đi từ thanh ghi cho bởi 3 bit Reg, D = 1 xác định dữ liệu sẽ đi đến thanh ghi cho bởi 3 bit Reg. Bit W xác định sẽ truyền 1 byte (W = 0) hay 1 word (W = 1). 3 bit Reg dùng để chọn thanh ghi sử dụng: Phạm Hùng Kim Khánh Trang 39
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý Bảng 2.10: Thanh ghi Mã W=1 W=0 000 AX AL 001 CX CL 010 DX DL 011 BX BL 100 SP AH 101 DI CH 110 BP DH 111 SI BH 2 bit mod và 3 bit R/M (Register / Memory) dùng để xác định chế độ địa chỉ cho các toán hạng của lệnh. Bảng 2.11: MOD 11 00 01 10 R/M W=1 W=0 000 [BX]+[SI] [BX]+[SI]+addr8 [BX]+[SI]+addr16 AX AL 001 [BX]+[DI] [BX]+[DI]+addr8 [BX]+[DI]+addr16 CX CL 010 [BP]+[SI] [BP]+[SI] +addr8 [BP]+[SI] +addr16 DX DL 011 [BP]+[DI] [BP]+[DI] +addr8 [BP]+[DI] +addr16 BX BL 100 [SI] [SI] +addr8 [SI] +addr16 SP AH 101 [DI] [DI] +addr8 [DI] +addr16 BP CH 110 addr16 [BP] +addr8 [BP] +addr16 SI DH 111 [BX] [BX] +addr8 [BX] +addr16 DI BH Tổng quát, 8086/8088 có khoảng 300 tác vụ có thể có trong tập lệnh của nó. Mỗi lệnh kéo dài từ 1 đến 6 byte. Từ ví dụ trên, ta thấy mã lệnh có các vùng: - Vùng mã lệnh (opcode): chứa mã lệnh của lệnh sẽ thực thi - Vùng thanh ghi (reg): chứa các thanh ghi sẽ thực hiện (bảng 2.10) - Vùng chế độ (mod): (bảng 2.11) 00: toán hạng bộ nhớ trực tiếp nếu R/M = 110, ngược lại là toán hạng gián tiếp 01: toán hạng gián tiếp, độ dời 8 bit 10: toán hạng gián tiếp, độ dời 16 bit 11: sử dụng 2 thanh ghi, vùng R/M sẽ là vùng Reg - Vùng thanh ghi / bộ nhớ R/M (Reg/Mem): (bảng 2.11) Phạm Hùng Kim Khánh Trang 40
- Tài liệu vi xử lý Tổ chức hệ thống vi xử lý 4. Các cách định địa chỉ Bảng 2.12: Cách định Mã đối Ví dụ địa chỉ tượng Từ gợi nhớ Đoạn Hoạt động Mô tả truy xuất Tức thời B80010 MOV AX,1000h Mã AH ← 10h (1) AL ← 00h Thanh ghi 8BD1 MOV DX,CX Trong µP DX ← CX (2) Trực tiếp 8A260010 MOV AH,[1000h] Döõ AH ← [1000h] (3) lieäu Gián tiếp 8B04 MOV AX,[SI] Dữ liệu AL ← [SI]; AH ←[SI+1] (4) thanh ghi FF25 JMP [DI] Dữ liệu IP←[DI+1:DI] FE4600 INC BYTE PTR [BP] Stack [BP]←[BP]+1 FF0F DEC WORD PTR [BX] Dữ liệu [BX+1:BX]← [BX+1:BX]-1 Có chỉ số 8B4406 MOV AX,[SI+6] Dữ liệu AL ← [SI+6]; AH ←[SI+7] (5) FF6506 JMP [DI+6] Dữ liệu IP←[DI+7:DI+6] Có nền 8B4602 MOV AX,[BP+2] Stack AL←[BP+2]; AH ←[BP+3] (6) FF6702 JMP [BP+2] Dữ liệu IP←[BX+3:BX+6] Có nền và 8B00 MOV AX,[BX+SI] Dữ liệu AL←[BX+SI];AH←[BX+SI+1] (7) có chỉ số FF21 JMP [BX+DI] Dữ liệu IP←[BX+DI+1:BX+DI] FE02 INC BYTE PTR [BP+SI] Stack [BP+SI]←[BP+SI]+1 FF0B DEC WORD PTR [BP+DI] Stack [BP+DI+1:BP+DI]← [BP+DI+1:BP+DI]-1 Có nền và 8B4005 MOV AX,[BX+SI+5] Dữ liệu AL←[BX+SI+5] (8) có chỉ số FF6105 AH←[BX+SI+1] với độ dời FE4205 JMP [BX+DI+5] Dữ liệu IP←[BX+DI+6:BX+DI+5] FF4B05 INC BYTE PTR [BP+SI+5] Stack [BP+SI+5]←[BP+SI+5]+1 DEC WORD PTR [BP+DI+5] Stack [BP+DI+6:BP+DI+5]← [BP+DI+6:BP+DI+5]-1 String A4 MOVSB Thêm, [ES:DI] ← [DS:DI] (9) dữ liệu Nếu DF = 0 thì SI ← SI + 1; DI ← DI + 1 Nếu DF = 1 thì SI ← SI - 1; DI ← DI - 1 - BYTE PTR và WORD PTR tránh lầm giữa truy xuất byte và word. - Độ dời được cộng vào thanh ghi con trỏ hay nền là số nhị phân dạng bù 2. - (1): nguồn dữ liệu trong lệnh - (2): đích và nguồn là các thanh ghi của µP - (3): địa chỉ bộ nhớ cung cấp trong lệnh - (4): địa chỉ bộ nhớ cung cấp trong thanh ghi con trỏ hay chỉ số - (5): địa chỉ bộ nhớ là tổng của thanh ghi chỉ số cộng với độ dời trong lệnh - (6): địa chỉ bộ nhớ là tổng của thanh ghi BX hay BP cộng với độ dời trong lệnh - (7): địa chỉ bộ nhớ là tổng của thanh ghi chỉ số và thanh ghi nền Phạm Hùng Kim Khánh Trang 41
CÓ THỂ BẠN MUỐN DOWNLOAD
-
Giáo trình kỹ thuật vi xử lý tập 1 part 2
54 p |
284 |
178
-
Chương 3: Tập lệnh của vi xử lý
144 p |
405 |
167
-
Giới thiệu chương trình kỹ thuật vi xử lý
11 p |
229 |
111
-
Phần chương trình viết trên vi xử lý
110 p |
321 |
99
-
Lập trình java căn bản - Chương 6: Lập trình Menu với AWT (tiếp)
30 p |
269 |
99
-
Chương 3 - Bộ Vi xử lý 8088
70 p |
218 |
87
-
Chương 10 - Các bộ vi xử lý tiên tiến của INTEL
12 p |
182 |
46
-
Chương 7 - Ngắt và xử lý ngắt trong hệ 8088
27 p |
124 |
44
-
Bài giảng Kỹ thuật vi xử lý (TS.Phạm Hoàng Duy) - Chương 1: Tổng quan hệ vi xử lý
30 p |
136 |
36
-
Kỹ thuật vi xử lý- chương 1:Tổng quan về vi xử lý và hệ xử lý
38 p |
57 |
20
-
Chương 9 - Một số phối ghép cơ bản
59 p |
68 |
18
-
Bài giảng Kỹ thuật vi xử lý và lập trình hợp ngữ
165 p |
35 |
16
-
Chương 2 - Máy tính trong hệ thống vi xử lý
8 p |
69 |
13
-
Bài giảng Vi xử lý – Vi điều khiển
222 p |
35 |
12
-
Tài liệu vi xử lý - Chương 3
30 p |
48 |
8
-
Bài giảng Vi xử lý: Phần 2 - Đại học Công nghiệp TP. HCM
99 p |
26 |
6
-
Bài giảng Ứng dụng vi điều khiển - Microcontroller Applications
56 p |
19 |
1

Server: Apache/2.2.31 (CentOS)

Set-Cookie: TLDEVNamespace=ti0b9pvm8svv03pin6f3v3l3m2; path=/; domain=.tailieu.vn; HttpOnly


text:
Luật số: 14/2008/QH12
Chia sẻ: Đặng Quỳnh Như | Ngày: | Loại File: PPT | Số trang:53
lượt xem 127
download
Luật số: 14/2008/QH12
LUẬT THUẾ THU NHẬP DOANH NGHIỆP
Bình luận(0) Đăng nhập để gửi bình luận!
Nội dung Text: Luật số: 14/2008/QH12
- LUẬT THUẾ THU NHẬP DOANH NGHIỆP Luật số: 14/2008/QH12, ngày 03/6/2008 Người GT: Nguyễn Thị Cúc Chủ tịch Hội tư vấn thuế Việt nam
- NỘI DUNG SỰ CẦN THIẾT PHẢI BAN HÀNH LUẬT THUẾ TNDN MỤC TIÊU YÊU CẦU SỬA ĐỔI LUẬT THUẾ TNDN NỘI DUNG MỚI CỦA LUẬT THUẾ TNDN
- SỰ CẦN THIẾT Luật thuế TNDN hiện hành 01/01/2004 thay thế Luật thuế TNDN (1997). TNDN góp phần cải thiện môi trường đầu tư, thúc đẩy cải cách hành chính trong quản lý thuế và thực hiện ưu đãi đầu tư; đáp ứng được yêu cầu của thực tiễn Việt nam góp phần bảo đảm nguồn thu quan trọng của NSNN: năm 2003: 36.305 tỷ; 2004: 42.798 tỷ ; 2005: 60.153 tỷ ; 2006: 75.256 tỷ, trong đó dầu thô chiếm 50%.
- SỰ CẦN THIẾT Những nhược điểm, hạn chế : 1. Thuế suất 28% chưa thực sự cạnh tranh trong thu hút đầu tư nước ngoài do các nước trong khu vực đã có sự điều chỉnh giảm; 2. Ưu đãi thuế còn dàn trải, phức tạp, chưa phát huy hiệu quả phân bổ nguồn lực trong đầu tư để đáp ứng yêu cầu về phát triển KT theo vùng và lãnh thổ, nhất là thu hút đầu tư vào các địa bàn có điều kiện KT XH đặc biệt khó khăn;
- SỰ CẦN THIẾT 3. Căn cứ tính thuế (bao gồm thu nhập chịu thuế, chi phí được trừ và không được trừ) chưa thực sự minh bạch, chưa phù hợp với thông lệ quốc tế. 4. Một số nội dung của Luật đã được chuyển sang điều chỉnh tại các Luật khác như Luật quản lý thuế, Luật thuế thu nhập cá nhân.
- MỤC TIÊU, YÊU CẦU Chương trình cải cách hệ thống thuế đến năm 2010 đã xác định là: “hoàn thiện theo hướng giảm mức TS, giảm diện miễn, giảm thuế; thống nhất mức TS và ưu đãi thuế giữa các thành phần KT để khuyến khích đầu tư và đảm bảo bình đẳng trong cạnh tranh”
- MỤC TIÊU, YÊU CẦU Một là, Tiếp tục tạo môi trường đầu tư và KD thuận lợi, bảo đảm công bằng, bình đẳng trong cạnh tranh; thực hiện giảm mức TS chung để DN có thêm nguồn lực tài chính, tăng tích luỹ, tích tụ đổi mới thiết bị, đẩy mạnh đầu tư phát triển, nâng cao năng lực cạnh tranh.
- MỤC TIÊU, YÊU CẦU Hai là, Cải cách ưu đãi thuế nhằm chuyển biến trong phân bổ nguồn lực, khuyến khích và thu hút đầu tư có chọn lọc để PT các vùng có điều kiện KT XH đặc biệt khó khăn và một số ít ngành, lĩnh vực quan trọng theo CS phát triển của Nhà nước, thu hẹp diện ưu đãi theo ngành, lĩnh vực. Ba là, Tuy có tác động giảm thu NSNN trong vài năm đầu nhưng phải đảm bảo ổn định và tăng trưởng nguồn thu NSNN trong trung và dài hạn.
- NỘI DUNG LUẬT Luật thuế thu nhập doanh nghiệp gồm 4 chương, 20 Điều Chương I: những quy định chung( 5 Điều) Chương II: Căn cứ và phương pháp tính thuế (7 Điều) Chương III:Ưu đãi thuế TNDN (6 Điều) Chương IV : Điều khoản thi hành( 2 Điều) Bài trình bày Luật được theo thứ tự các Điều Các phần in đậm là nội dung mới so với Luật hiện hành
- 1. Về Phạm vi điều chỉnh: Điều 1 Luật quy định về người nộp thuế, thu nhập chịu thuế, thu nhập được miễn thuế, căn cứ tính thuế, phương pháp tính thuế và ưu đãi thuế TNDN
- 2. Người nộp thuế: Điều 2 (HH Điều 1; kh.4, Đ.13; Kh. 1, 3 Đ.3) 1. Người nộp thuế TNDN là các tổ chức có hoạt động SX, KD hàng hóa, DV có TNCT theo quy định của Luật gồm: a. DN được thành lập theo quy định của pháp luật Việt Nam; b. DN được thành lập theo quy định của PL nước ngoài có cơ sở thường trú hoặc không có cơ sở thường trú tại VN;
- 2. Người nộp thuế c. Tổ chức được thành lập theo Luật hợp tác xã; d. Đơn vị sự nghiệp được thành lập theo quy định của PL Việt Nam; đ. Tổ chức khác có hoạt động SX, KD có thu nhập.
- 2. Người nộp thuế 2. DN có TNCT nộp thuế TNDN như sau: a) DN được thành lập theo quy định của pháp luật VN nộp thuế đối với TNCT phát sinh tại VN và TNCT phát sinh ngoài VN; b) DN nước ngoài có cơ sở thường trú tại Việt Nam nộp thuế đối với TNCT phát sinh tại Việt Nam và TNCT phát sinh ngoài VN liên quan đến hoạt động của cơ sở thường trú đó;
- 2. Người nộp thuế c) DN nước ngoài có cơ sở thường trú tại Việt Nam nộp thuế đối với TNCT phát sinh tại Việt Nam mà khoản thu nhập này không liên quan đến hoạt động của cơ sở thường trú; d) DN nước ngoài không có cơ sở thường trú tại Việt Nam nộp thuế đối với TNCT phát sinh tại Việt Nam
- 2. Người nộp thuế 3. Cơ sở thường trú của DN nước ngoài là cơ sở KD mà thông qua đó, DN nước ngoài tiến hành một phần hoặc toàn bộ hoạt động SX,KD tại VN mang lại thu nhập, bao gồm: a) Chi nhánh, văn phòng điều hành, nhà máy, công xưởng, phương tiện vận tải, hầm mỏ, mỏ dầu, khí hoặc địa điểm khai thác tài nguyên thiên nhiên khác tại Việt Nam; b) Địa điểm xây dựng, công trình XD, lắp đặt, lắp ráp;
- 2. Người nộp thuế c) Cơ sở cung cấp dịch vụ bao gồm cả DV tư vấn thông qua người làm công hay một tổ chức, cá nhân khác; d) Đại lý cho doanh nghiệp nước ngoài; đ) Đại diện tại VN trong các trường hợp là đại diện có thẩm quyền ký kết HĐ đứng tên DN nước ngoài hoặc đại diện không có thẩm quyền ký kết HĐ đứng tên DN nước ngoài nhưng thường xuyên thực hiện việc giao HH hoặc cung ứng DV tại Việt Nam;
- 3. Thu nhập chịu thuế, TN miễn thuế: Đ. 3, Đ. 4 (HH Đ. 2, Đ. 6, kh. 1 Đ. 19) Thu nhập chịu thuế 1. TNCT là thu nhập từ hoạt động SX, KD hàng hoá, dịch vụ và TN khác. 2. Thu nhập khác: TN từ chuyển nhượng vốn, chuyển nhượng bất ĐS; TN từ quyền sở hữu, quyền sử dụng TS; TN từ chuyển nhượng, cho thuê, thanh lý TS;
- 3. Thu nhập chịu thuế 2. Thu nhập khác (tiếp) thu nhập từ lãi tiền gửi, cho vay vốn, bán ngoại tệ; hoàn nhập các khoản dự phòng; thu khoản nợ khó đòi đã xoá nay đòi được; thu khoản nợ phải trả không xác định được chủ; khoản thu nhập từ KD của những năm trước bị bỏ sót và các khoản TN khác, kể cả TN nhận được từ hoạt động SX, KD ở ngoài Việt Nam.
- 4.Thu nhập miễn thuế 1. Thu nhập từ trồng trọt, chăn nuôi, nuôi trồng thủy sản của các tổ chức được thành lập theo Luật hợp tác xã. 2. Thu nhập từ việc thực hiện dịch vụ kỹ thuật trực tiếp phục vụ nông nghiệp.
- 4.Thu nhập miễn thuế 3. Thu nhập từ việc thực hiện dịch vụ kỹ thuật trực tiếp phục vụ nông nghiệp. 4. Thu nhập từ hoạt động SX, KD hàng hoá, dịch vụ của DN dành riêng cho lao động là người tàn tật, người sau cai nghiện; người nhiễm HIV. CP quy định tiêu chí, điều kiện xác định.
CÓ THỂ BẠN MUỐN DOWNLOAD
-
Văn bản Luật thuế giá trị gia tăng
7 p | 310 | 133
-
LUẬT QUẢN LÝ THUẾ SỐ 78/2006/QH11 CỦA QUỐC HỘI KHOÁ XI, KỲ HỌP THỨ 10
58 p | 226 | 122
-
Luật Thuế tiêu thụ đặc biệt số 05/1998/QH10 của Quốc hội
12 p | 267 | 74
-
Văn bản Luật thuế thu nhập cá nhân
11 p | 169 | 65
-
Luật số 45/2009/QH12 của Quốc hội
7 p | 150 | 60
-
Văn bản Luật thuế sử dụng đất phi nông nghiệp
8 p | 142 | 48
-
Văn bản Luật thuế xuất nhập khẩu
8 p | 107 | 42
-
Luật số 48/2010/QH12 ngày 17/6/2010 của Quốc hội
7 p | 213 | 36
-
Luật số 29/2009/QH12 của Quốc hội
28 p | 110 | 35
-
Luật số 04/2007/QH12 của Quốc hội
14 p | 123 | 20
-
Luật số: 48/2010/QH12
8 p | 119 | 12
-
Luật số 57/2005/QH11 của Quốc hội
3 p | 98 | 9
-
Luật số 08/VBHN-VPQH
16 p | 30 | 8
-
Luật số 08/2003/QH11
4 p | 87 | 4
-
Luật số 04/2007 và luật thuế thu nhập cá nhân
14 p | 35 | 4
-
Luật số 31/2013/QH13 2013
15 p | 38 | 3
-
Luật số 54/2014/QH13
54 p | 35 | 3
-
Luật số 32/2013/QH13 2013
22 p | 38 | 2

markdown:
# Luật số: 14/2008/QH12
Chia sẻ: Đặng Quỳnh Như | Ngày: | Loại File: PPT | Số trang:53
lượt xem 127
download
![](http://image1.tailieu.vn/document/thumbnail/2010/20100107/notebook/80x100/luat_thue_tndn_2_9398.jpg)
##
Luật số: 14/2008/QH12
[Vui lòng tải xuống để xem tài liệu đầy đủ](javascript:void(0);)
Download
![](http://static1.tailieu.vn/b2013az/templates/version1/default/images/down16x21.png)
LUẬT THUẾ THU NHẬP DOANH NGHIỆP
Bình luận(0)
[Đăng nhập để gửi bình luận!](javascript:void(0);)
##
Nội dung Text: Luật số: 14/2008/QH12
- LUẬT THUẾ THU NHẬP DOANH NGHIỆP Luật số: 14/2008/QH12, ngày 03/6/2008 Người GT: Nguyễn Thị Cúc Chủ tịch Hội tư vấn thuế Việt nam
- NỘI DUNG SỰ CẦN THIẾT PHẢI BAN HÀNH LUẬT THUẾ TNDN MỤC TIÊU YÊU CẦU SỬA ĐỔI LUẬT THUẾ TNDN NỘI DUNG MỚI CỦA LUẬT THUẾ TNDN
- SỰ CẦN THIẾT Luật thuế TNDN hiện hành 01/01/2004 thay thế Luật thuế TNDN (1997). TNDN góp phần cải thiện môi trường đầu tư, thúc đẩy cải cách hành chính trong quản lý thuế và thực hiện ưu đãi đầu tư; đáp ứng được yêu cầu của thực tiễn Việt nam góp phần bảo đảm nguồn thu quan trọng của NSNN: năm 2003: 36.305 tỷ; 2004: 42.798 tỷ ; 2005: 60.153 tỷ ; 2006: 75.256 tỷ, trong đó dầu thô chiếm 50%.
- SỰ CẦN THIẾT Những nhược điểm, hạn chế : 1. Thuế suất 28% chưa thực sự cạnh tranh trong thu hút đầu tư nước ngoài do các nước trong khu vực đã có sự điều chỉnh giảm; 2. Ưu đãi thuế còn dàn trải, phức tạp, chưa phát huy hiệu quả phân bổ nguồn lực trong đầu tư để đáp ứng yêu cầu về phát triển KT theo vùng và lãnh thổ, nhất là thu hút đầu tư vào các địa bàn có điều kiện KT XH đặc biệt khó khăn;
- SỰ CẦN THIẾT 3. Căn cứ tính thuế (bao gồm thu nhập chịu thuế, chi phí được trừ và không được trừ) chưa thực sự minh bạch, chưa phù hợp với thông lệ quốc tế. 4. Một số nội dung của Luật đã được chuyển sang điều chỉnh tại các Luật khác như Luật quản lý thuế, Luật thuế thu nhập cá nhân.
- MỤC TIÊU, YÊU CẦU Chương trình cải cách hệ thống thuế đến năm 2010 đã xác định là: “hoàn thiện theo hướng giảm mức TS, giảm diện miễn, giảm thuế; thống nhất mức TS và ưu đãi thuế giữa các thành phần KT để khuyến khích đầu tư và đảm bảo bình đẳng trong cạnh tranh”
- MỤC TIÊU, YÊU CẦU Một là, Tiếp tục tạo môi trường đầu tư và KD thuận lợi, bảo đảm công bằng, bình đẳng trong cạnh tranh; thực hiện giảm mức TS chung để DN có thêm nguồn lực tài chính, tăng tích luỹ, tích tụ đổi mới thiết bị, đẩy mạnh đầu tư phát triển, nâng cao năng lực cạnh tranh.
- MỤC TIÊU, YÊU CẦU Hai là, Cải cách ưu đãi thuế nhằm chuyển biến trong phân bổ nguồn lực, khuyến khích và thu hút đầu tư có chọn lọc để PT các vùng có điều kiện KT XH đặc biệt khó khăn và một số ít ngành, lĩnh vực quan trọng theo CS phát triển của Nhà nước, thu hẹp diện ưu đãi theo ngành, lĩnh vực. Ba là, Tuy có tác động giảm thu NSNN trong vài năm đầu nhưng phải đảm bảo ổn định và tăng trưởng nguồn thu NSNN trong trung và dài hạn.
- NỘI DUNG LUẬT Luật thuế thu nhập doanh nghiệp gồm 4 chương, 20 Điều Chương I: những quy định chung( 5 Điều) Chương II: Căn cứ và phương pháp tính thuế (7 Điều) Chương III:Ưu đãi thuế TNDN (6 Điều) Chương IV : Điều khoản thi hành( 2 Điều) Bài trình bày Luật được theo thứ tự các Điều Các phần in đậm là nội dung mới so với Luật hiện hành
- 1. Về Phạm vi điều chỉnh: Điều 1 Luật quy định về người nộp thuế, thu nhập chịu thuế, thu nhập được miễn thuế, căn cứ tính thuế, phương pháp tính thuế và ưu đãi thuế TNDN
- 2. Người nộp thuế: Điều 2 (HH Điều 1; kh.4, Đ.13; Kh. 1, 3 Đ.3) 1. Người nộp thuế TNDN là các tổ chức có hoạt động SX, KD hàng hóa, DV có TNCT theo quy định của Luật gồm: a. DN được thành lập theo quy định của pháp luật Việt Nam; b. DN được thành lập theo quy định của PL nước ngoài có cơ sở thường trú hoặc không có cơ sở thường trú tại VN;
- 2. Người nộp thuế c. Tổ chức được thành lập theo Luật hợp tác xã; d. Đơn vị sự nghiệp được thành lập theo quy định của PL Việt Nam; đ. Tổ chức khác có hoạt động SX, KD có thu nhập.
- 2. Người nộp thuế 2. DN có TNCT nộp thuế TNDN như sau: a) DN được thành lập theo quy định của pháp luật VN nộp thuế đối với TNCT phát sinh tại VN và TNCT phát sinh ngoài VN; b) DN nước ngoài có cơ sở thường trú tại Việt Nam nộp thuế đối với TNCT phát sinh tại Việt Nam và TNCT phát sinh ngoài VN liên quan đến hoạt động của cơ sở thường trú đó;
- 2. Người nộp thuế c) DN nước ngoài có cơ sở thường trú tại Việt Nam nộp thuế đối với TNCT phát sinh tại Việt Nam mà khoản thu nhập này không liên quan đến hoạt động của cơ sở thường trú; d) DN nước ngoài không có cơ sở thường trú tại Việt Nam nộp thuế đối với TNCT phát sinh tại Việt Nam
- 2. Người nộp thuế 3. Cơ sở thường trú của DN nước ngoài là cơ sở KD mà thông qua đó, DN nước ngoài tiến hành một phần hoặc toàn bộ hoạt động SX,KD tại VN mang lại thu nhập, bao gồm: a) Chi nhánh, văn phòng điều hành, nhà máy, công xưởng, phương tiện vận tải, hầm mỏ, mỏ dầu, khí hoặc địa điểm khai thác tài nguyên thiên nhiên khác tại Việt Nam; b) Địa điểm xây dựng, công trình XD, lắp đặt, lắp ráp;
- 2. Người nộp thuế c) Cơ sở cung cấp dịch vụ bao gồm cả DV tư vấn thông qua người làm công hay một tổ chức, cá nhân khác; d) Đại lý cho doanh nghiệp nước ngoài; đ) Đại diện tại VN trong các trường hợp là đại diện có thẩm quyền ký kết HĐ đứng tên DN nước ngoài hoặc đại diện không có thẩm quyền ký kết HĐ đứng tên DN nước ngoài nhưng thường xuyên thực hiện việc giao HH hoặc cung ứng DV tại Việt Nam;
- 3. Thu nhập chịu thuế, TN miễn thuế: Đ. 3, Đ. 4 (HH Đ. 2, Đ. 6, kh. 1 Đ. 19) Thu nhập chịu thuế 1. TNCT là thu nhập từ hoạt động SX, KD hàng hoá, dịch vụ và TN khác. 2. Thu nhập khác: TN từ chuyển nhượng vốn, chuyển nhượng bất ĐS; TN từ quyền sở hữu, quyền sử dụng TS; TN từ chuyển nhượng, cho thuê, thanh lý TS;
- 3. Thu nhập chịu thuế 2. Thu nhập khác (tiếp) thu nhập từ lãi tiền gửi, cho vay vốn, bán ngoại tệ; hoàn nhập các khoản dự phòng; thu khoản nợ khó đòi đã xoá nay đòi được; thu khoản nợ phải trả không xác định được chủ; khoản thu nhập từ KD của những năm trước bị bỏ sót và các khoản TN khác, kể cả TN nhận được từ hoạt động SX, KD ở ngoài Việt Nam.
- 4.Thu nhập miễn thuế 1. Thu nhập từ trồng trọt, chăn nuôi, nuôi trồng thủy sản của các tổ chức được thành lập theo Luật hợp tác xã. 2. Thu nhập từ việc thực hiện dịch vụ kỹ thuật trực tiếp phục vụ nông nghiệp.
- 4.Thu nhập miễn thuế 3. Thu nhập từ việc thực hiện dịch vụ kỹ thuật trực tiếp phục vụ nông nghiệp. 4. Thu nhập từ hoạt động SX, KD hàng hoá, dịch vụ của DN dành riêng cho lao động là người tàn tật, người sau cai nghiện; người nhiễm HIV. CP quy định tiêu chí, điều kiện xác định.
CÓ THỂ BẠN MUỐN DOWNLOAD
-
Văn bản Luật thuế giá trị gia tăng
7 p |
310 |
133
-
LUẬT QUẢN LÝ THUẾ SỐ 78/2006/QH11 CỦA QUỐC HỘI KHOÁ XI, KỲ HỌP THỨ 10
58 p |
226 |
122
-
Luật Thuế tiêu thụ đặc biệt số 05/1998/QH10 của Quốc hội
12 p |
267 |
74
-
Văn bản Luật thuế thu nhập cá nhân
11 p |
169 |
65
-
Luật số 45/2009/QH12 của Quốc hội
7 p |
150 |
60
-
Văn bản Luật thuế sử dụng đất phi nông nghiệp
8 p |
142 |
48
-
Văn bản Luật thuế xuất nhập khẩu
8 p |
107 |
42
-
Luật số 48/2010/QH12 ngày 17/6/2010 của Quốc hội
7 p |
213 |
36
-
Luật số 29/2009/QH12 của Quốc hội
28 p |
110 |
35
-
Luật số 04/2007/QH12 của Quốc hội
14 p |
123 |
20
-
Luật số: 48/2010/QH12
8 p |
119 |
12
-
Luật số 57/2005/QH11 của Quốc hội
3 p |
98 |
9
-
Luật số 08/VBHN-VPQH
16 p |
30 |
8
-
Luật số 08/2003/QH11
4 p |
87 |
4
-
Luật số 04/2007 và luật thuế thu nhập cá nhân
14 p |
35 |
4
-
Luật số 31/2013/QH13 2013
15 p |
38 |
3
-
Luật số 54/2014/QH13
54 p |
35 |
3
-
Luật số 32/2013/QH13 2013
22 p |
38 |
2

WARC-Type: response

Content-Type: application/http; msgtype=response

WARC-Identified-Payload-Type: application/xhtml+xml

Connection: close

Pragma: no-cache

Cache-Control: no-store, no-cache, must-revalidate, post-check=0, pre-check=0

Set-Cookie: TLDEVNamespace=1chlql61jsoll22ddmeqphbqo1; path=/; domain=.tailieu.vn; HttpOnly

Vary: Accept-Encoding

Content-Type: text/html; charset=UTF-8


text:
Mạch diode
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giớ chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo như các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
22p hominhtampro 28-10-2010 918 288 Download
-
Chương 1: Mạch Diode CHƯƠNG I MẠCH DIODE Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giới hạn ở diode chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo nhu cầu ứng dụng, các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch. 1.1 ÐƯỜNG THẲNG LẤY ÐIỆN (LOAD LINE): Xem mạch hình 1.
23p augi19 01-03-2012 135 47 Download
-
Diode là một linh kiện bán dẫn 2 cực, cấu tạo cơ bản dựa trên chuyển tiếp PN. Trong chương 2 của bài giảng Kỹ thuật điện tử, chúng ta sẽ cùng tìm hiểu về cấu tạo và nguyên tắc hoạt động của Diode bán dẫn, đặc tuyến Volt-Ampe (V-A) của diode, các mô hình mạch diode tương đương,... Mời các bạn cùng tham khảo để nắm bắt các nội dung chi tiết.
28p namthangtinhlang_01 31-10-2015 127 34 Download
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn ( giới hạn ở diode chỉnh lưu và diode zener_ Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tuỳ theo nhu cầu ứng dụng, các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
292p vhkhoi 08-12-2009 1441 858 Download
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giới hạn ở diode chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo nhu cầu ứng dụng, các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
260p sieuquay91 27-09-2011 445 218 Download
-
Tài liệu tham khảo Giáo trình mạch điện tử - Chương 1: Diode bán dẫn
0p vanthang122141 10-11-2010 411 214 Download
-
Tài liệu tham khảo Giáo trình mạch điện tử - Chương 3: ổn định phân cực cho BJT
0p vanthang122141 10-11-2010 285 148 Download
-
Tóm tắt lý thuyết và bài tập phần Diode môn Kỹ thuật điện tử trình bày lý thuyết về quan hệ giữa dòng điện và điện áp, điện trở DC, phân tích mạch DC có diode, phân tích mạch diode với tín hiệu nhỏ,... và phần bài tập với các vấn đề liên quan có đáp án đi kèm, thuận tiện cho sinh viên đối chiếu.
9p mnhat91 16-04-2014 465 130 Download
-
Cuốn sách Mạch điện tử gồm các nội dung: mạch Diode, mạch phân cực và khuếch đại tín hiệu nhỏ dùng BJT, mạch phân cực và khuếch đại tín hiệu nhỏ dùng FET, anh hưởng của nội trở nguồn tín hiệu (Rs) và tổng trở tải (RL) lên mạch khuếch đại, đáp ứng tần số của BJT và FET, các dạng liên kết của BJT và FET, Op-Amp khuếch đại và ứng dụng, mạch khuếch đại hồi tiếp (Feedback Amp), mạch khuếch đại công suất (Power Amp), mạch dao động (Oscillators).
292p ngocluu84 28-03-2014 261 118 Download
-
Đường thẳng lấy điện. Diode trong mạch điện một chiều. Diode trong mạch điện xoay chiều. Mạch cắt( Clippers). Mạch ghim áp( Clampers). Mạch dùng diode zener. Mạch chỉnh lưu bội áp. Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giới hạn ở diode chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết).
5p poseidon06 01-08-2011 293 84 Download
-
Mục tiêu: Cung cấp kiến thức cơ bản để phân tích, thiết kế các mạch điện tử ở tần số thấp. Trình bày đáp ứng tần số của mạch khuếch đại và đồ thị Bode. Trình bày các mạch khuếch đại thuật toán cơ bản. Nắm vững cách phân tích mạch diode, transistor...
53p levanhau_01031993 03-10-2013 332 58 Download
-
1.6.1 Diode zener với điện thế ngõ vào vi và tải RL cố định. 1.6.2 Nguồn vi cố định và RL thay đổi. 1.6.3 Tải RL cố định, điện thế ngõ vào vi thay đổi. Cũng tương tự như diode chỉnh lưu, với diode zener ta cũng dùng kiểu mẫu gần đúng trong việc phân giải mạch: Khi dẫn điện diode zener tương đương với một nguồn điện thế một chiều vz (điện thế zener) và khi ngưng nó tương đương với một mạch hở. 1.6.1.
5p poseidon06 01-08-2011 221 54 Download
-
GIÁO TRÌNH MẠCH ĐIỆN TỬ - CHƯƠNG I: MẠCH DIODE Đường thẳng lấy điện. Diode trong mạch điện một chiều. Diode trong mạch điện xoay chiều. Mạch cắt( Clippers). Mạch ghim áp( Clampers). Mạch dùng diode zener. Mạch chỉnh lưu bội áp. Bài tập cuối chương. 5. Vấn đề nghiên cứu của chương kế tiếp. Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giớ chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết).
0p muaythai6 15-11-2011 157 53 Download
-
Bài giảng Kỹ thuật điện tử: Chương 2 - Diode bán dẫn trình bày cấu tạo và nguyên tắc hoạt động của diode bán dẫn, đặc tuyến Volt-Ampe, các mô hình mạch diode tương đương, các tham số của diode bán dẫn, phân tích mạch DC chứa diode và một số nội dung khác.
28p hoahue91 19-07-2014 146 50 Download
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giớ chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo nhu c các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
22p hungchi88 18-05-2011 128 38 Download
-
Tham khảo tài liệu 'mạch điện tử - chương 4', kỹ thuật - công nghệ, điện - điện tử phục vụ nhu cầu học tập, nghiên cứu và làm việc hiệu quả
16p hungchi88 18-05-2011 97 35 Download
-
Tham khảo tài liệu 'mạch điện tử - chương 5', kỹ thuật - công nghệ, điện - điện tử phục vụ nhu cầu học tập, nghiên cứu và làm việc hiệu quả
19p hungchi88 18-05-2011 99 34 Download
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giớ chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo nhu c các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
22p thanhmaikmt 08-05-2011 96 32 Download
-
Hình 1.6 1.3.2. Mạch chỉnh lưu nửa sóng (một bán kỳ) Trong mạch này ta dùng kiểu mẫu lý tưởng hoặc gần đúng của diode trong việc phân tích mạch. Dạng mạch căn bản cùng các dạng sóng (thí dụ hình sin) ở ngõ vào và ngõ ra như hình 1.7 Diode chỉ dẫn điện khi bán kỳ dương của vi(t) đưa vào mạch Ta có: - Biên độ đỉnh của vo(t) Vdcm = Vm - 0.7V - Ðiện thế trung bình ngõ ra:
5p poseidon06 01-08-2011 97 32 Download
-
Tham khảo tài liệu 'mạch điện tử - chương 3', kỹ thuật - công nghệ, điện - điện tử phục vụ nhu cầu học tập, nghiên cứu và làm việc hiệu quả
16p hungchi88 18-05-2011 60 24 Download

markdown:
# Mạch diode
**Mạch diode**
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giớ chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo như các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
22p
hominhtampro
28-10-2010
918
288
Download
-
Chương 1: Mạch Diode CHƯƠNG I MẠCH DIODE Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giới hạn ở diode chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo nhu cầu ứng dụng, các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch. 1.1 ÐƯỜNG THẲNG LẤY ÐIỆN (LOAD LINE): Xem mạch hình 1.
23p
augi19
01-03-2012
135
47
Download
-
Diode là một linh kiện bán dẫn 2 cực, cấu tạo cơ bản dựa trên chuyển tiếp PN. Trong chương 2 của bài giảng Kỹ thuật điện tử, chúng ta sẽ cùng tìm hiểu về cấu tạo và nguyên tắc hoạt động của Diode bán dẫn, đặc tuyến Volt-Ampe (V-A) của diode, các mô hình mạch diode tương đương,... Mời các bạn cùng tham khảo để nắm bắt các nội dung chi tiết.
28p
namthangtinhlang_01
31-10-2015
127
34
Download
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn ( giới hạn ở diode chỉnh lưu và diode zener_ Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tuỳ theo nhu cầu ứng dụng, các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
292p
vhkhoi
08-12-2009
1441
858
Download
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giới hạn ở diode chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo nhu cầu ứng dụng, các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
260p
sieuquay91
27-09-2011
445
218
Download
-
Tài liệu tham khảo Giáo trình mạch điện tử - Chương 1: Diode bán dẫn
0p
vanthang122141
10-11-2010
411
214
Download
-
Tài liệu tham khảo Giáo trình mạch điện tử - Chương 3: ổn định phân cực cho BJT
0p
vanthang122141
10-11-2010
285
148
Download
-
Tóm tắt lý thuyết và bài tập phần Diode môn Kỹ thuật điện tử trình bày lý thuyết về quan hệ giữa dòng điện và điện áp, điện trở DC, phân tích mạch DC có diode, phân tích mạch diode với tín hiệu nhỏ,... và phần bài tập với các vấn đề liên quan có đáp án đi kèm, thuận tiện cho sinh viên đối chiếu.
9p
mnhat91
16-04-2014
465
130
Download
-
Cuốn sách Mạch điện tử gồm các nội dung: mạch Diode, mạch phân cực và khuếch đại tín hiệu nhỏ dùng BJT, mạch phân cực và khuếch đại tín hiệu nhỏ dùng FET, anh hưởng của nội trở nguồn tín hiệu (Rs) và tổng trở tải (RL) lên mạch khuếch đại, đáp ứng tần số của BJT và FET, các dạng liên kết của BJT và FET, Op-Amp khuếch đại và ứng dụng, mạch khuếch đại hồi tiếp (Feedback Amp), mạch khuếch đại công suất (Power Amp), mạch dao động (Oscillators).
292p
ngocluu84
28-03-2014
261
118
Download
-
Đường thẳng lấy điện. Diode trong mạch điện một chiều. Diode trong mạch điện xoay chiều. Mạch cắt( Clippers). Mạch ghim áp( Clampers). Mạch dùng diode zener. Mạch chỉnh lưu bội áp. Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giới hạn ở diode chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết).
5p
poseidon06
01-08-2011
293
84
Download
-
Mục tiêu: Cung cấp kiến thức cơ bản để phân tích, thiết kế các mạch điện tử ở tần số thấp. Trình bày đáp ứng tần số của mạch khuếch đại và đồ thị Bode. Trình bày các mạch khuếch đại thuật toán cơ bản. Nắm vững cách phân tích mạch diode, transistor...
53p
levanhau_01031993
03-10-2013
332
58
Download
-
1.6.1 Diode zener với điện thế ngõ vào vi và tải RL cố định. 1.6.2 Nguồn vi cố định và RL thay đổi. 1.6.3 Tải RL cố định, điện thế ngõ vào vi thay đổi. Cũng tương tự như diode chỉnh lưu, với diode zener ta cũng dùng kiểu mẫu gần đúng trong việc phân giải mạch: Khi dẫn điện diode zener tương đương với một nguồn điện thế một chiều vz (điện thế zener) và khi ngưng nó tương đương với một mạch hở. 1.6.1.
5p
poseidon06
01-08-2011
221
54
Download
-
GIÁO TRÌNH MẠCH ĐIỆN TỬ - CHƯƠNG I: MẠCH DIODE Đường thẳng lấy điện. Diode trong mạch điện một chiều. Diode trong mạch điện xoay chiều. Mạch cắt( Clippers). Mạch ghim áp( Clampers). Mạch dùng diode zener. Mạch chỉnh lưu bội áp. Bài tập cuối chương. 5. Vấn đề nghiên cứu của chương kế tiếp. Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giớ chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết).
0p
muaythai6
15-11-2011
157
53
Download
-
Bài giảng Kỹ thuật điện tử: Chương 2 - Diode bán dẫn trình bày cấu tạo và nguyên tắc hoạt động của diode bán dẫn, đặc tuyến Volt-Ampe, các mô hình mạch diode tương đương, các tham số của diode bán dẫn, phân tích mạch DC chứa diode và một số nội dung khác.
28p
hoahue91
19-07-2014
146
50
Download
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giớ chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo nhu c các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
22p
hungchi88
18-05-2011
128
38
Download
-
Tham khảo tài liệu 'mạch điện tử - chương 4', kỹ thuật - công nghệ, điện - điện tử phục vụ nhu cầu học tập, nghiên cứu và làm việc hiệu quả
16p
hungchi88
18-05-2011
97
35
Download
-
Tham khảo tài liệu 'mạch điện tử - chương 5', kỹ thuật - công nghệ, điện - điện tử phục vụ nhu cầu học tập, nghiên cứu và làm việc hiệu quả
19p
hungchi88
18-05-2011
99
34
Download
-
Trong chương này, chúng ta khảo sát một số mạch ứng dụng căn bản của diode bán dẫn (giớ chỉnh lưu và diode zener - Các diode đặc biệt khác sẽ được bàn đến lúc cần thiết). Tùy theo nhu c các mô hình lý tưởng, gần đúng hay thực sẽ được đưa vào trong công việc tính toán mạch.
22p
thanhmaikmt
08-05-2011
96
32
Download
-
Hình 1.6 1.3.2. Mạch chỉnh lưu nửa sóng (một bán kỳ) Trong mạch này ta dùng kiểu mẫu lý tưởng hoặc gần đúng của diode trong việc phân tích mạch. Dạng mạch căn bản cùng các dạng sóng (thí dụ hình sin) ở ngõ vào và ngõ ra như hình 1.7 Diode chỉ dẫn điện khi bán kỳ dương của vi(t) đưa vào mạch Ta có: - Biên độ đỉnh của vo(t) Vdcm = Vm - 0.7V - Ðiện thế trung bình ngõ ra:
5p
poseidon06
01-08-2011
97
32
Download
-
Tham khảo tài liệu 'mạch điện tử - chương 3', kỹ thuật - công nghệ, điện - điện tử phục vụ nhu cầu học tập, nghiên cứu và làm việc hiệu quả
16p
hungchi88
18-05-2011
60
24
Download

Set-Cookie: TLDEVNamespace=dkcfqgbpcm3gem4aj2diu3cpu6; path=/; domain=.tailieu.vn; HttpOnly